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參數(shù)資料
| 型號(hào)： | Q67120-C1056SAB-C501G-1EP |
| 英文描述： | IC-8-BIT CPU |
| 中文描述： | 集成電路8位CPU |
| 文件頁(yè)數(shù)： | 102/121頁(yè) |
| 文件大小： | 1000K |
| 代理商： | Q67120-C1056SAB-C501G-1EP |
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Semiconductor Group
10-5
Device Specifications
C501
10.4
V
CC
= 5 V + 10 %, – 15 %;
V
SS
= 0 V
AC Characteristics for C501-L / C501-1R / C501-1E
T
A
= 0 °C to 70 °C
T
A
= – 40 °C to 85 °C for the SAF-C501
for the SAB-C501
(
C
L
for port 0, ALE and PSEN outputs = 100 pF;
C
L
for all other outputs = 80 pF)
Program Memory Characteristics
*) Interfacing the C501 to devices with float times up to 75 ns is permissible. This limited bus contention will not
cause any damage to port 0 Drivers.
Parameter
Symbol
Limit Values
Unit
12 MHz
Clock
Variable Clock
1/
t
CLCL
= 3.5 MHz to 12 MHz
min.
2
t
CLCL
– 40
t
CLCL
– 40
t
CLCL
– 53
–
t
CLCL
– 25
3
t
CLCL
– 35
–
min.
max.
max.
ALE pulse width
t
LHLL
t
AVLL
t
LLAX
t
LLIV
t
LLPL
t
PLPH
t
PLIV
t
PXIX
t
PXIZ*)
t
PXAV*)
t
AVIV
t
AZPL
127
–
–
ns
Address setup to ALE
43
–
–
ns
Address hold after ALE
30
–
–
4
t
CLCL
– 100
–
ns
ALE low to valid instr in
–
233
ns
ALE to PSEN
58
–
ns
PSEN pulse width
215
–
–
3
t
CLCL
– 100
–
t
CLCL
– 20
–
5
t
CLCL
– 115
–
ns
PSEN to valid instr in
–
150
ns
Input instruction hold after PSEN
0
–
0
ns
Input instruction float after PSEN
–
63
–
t
CLCL
– 8
–
ns
Address valid after PSEN
75
–
ns
Address to valid instr in
–
302
ns
Address float to PSEN
0
–
0
ns
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