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參數(shù)資料
| 型號： | TMS320VC5409PGE-80 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 49/93頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIXED POINT DSP 144-LQFP |
| 標(biāo)準包裝： | 60 |
| 系列： | TMS320C54x |
| 類型： | 定點 |
| 接口： | 主機接口，McBSP |
| 時鐘速率： | 80MHz |
| 非易失內(nèi)存： | ROM（32 kB） |
| 芯片上RAM： | 64kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.80V |
| 工作溫度： | -40°C ~ 100°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-LQFP（20x20） |
| 包裝： | 托盤 |
| 配用： | 296-15829-ND - DSP STARTER KIT FOR TMS320C5416 |
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Documentation Support
53
April 1999 Revised October 2008
SPRS082F
5.5
Divide-By-Two/Divide-By-Four Clock Option (PLL Disabled)
The frequency of the reference clock provided at the X2/CLKIN pin can be divided by a factor of two or four
to generate the internal machine cycle. The selection of the clock mode is described in the clock generator
section.
When an external clock source is used, the frequency injected must conform to specifications listed in the
timing requirements table. Table 52 and Table 53 assumes testing over recommended operating conditions
and H = 0.5tc(CO) (see Figure 53).
Table 52.
Divide-By-Two/Divide-By-Four Clock Option (PLL Disabled) Timing Requirements
MIN
MAX
UNIT
tc(CI)
Cycle time, X2/CLKIN
20
ns
tf(CI)
Fall time, X2/CLKIN
8
ns
tr(CI)
Rise time, X2/CLKIN
8
ns
tw(CIL)
Pulse duration, X2/CLKIN low
5
ns
tw(CIH)
Pulse duration, X2/CLKIN high
5
ns
This device utilizes a fully static design and therefore can operate with tc(CI) approaching ∞. The device is characterized at frequencies
approaching 0 Hz.
Table 53.
Divide-By-Two/Divide-By-Four Clock Option (PLL Disabled) Switching Characteristics
PARAMETER
MIN
TYP
MAX
UNIT
tc(CO)
Cycle time, CLKOUT
40
2tc(CI)
ns
td(CIH-CO)
Delay time, X2/CLKIN high to CLKOUT high/low
4
10
17
ns
tf(CO)
Fall time, CLKOUT
2
ns
tr(CO)
Rise time, CLKOUT
2
ns
tw(COL)
Pulse duration, CLKOUT low
H2
H1
H
ns
tw(COH)
Pulse duration, CLKOUT high
H2
H1
H
ns
This device utilizes a fully static design and therefore can operate with tc(CI) approaching ∞. The device is characterized at frequencies
approaching 0 Hz.
tr(CO)
tf(CO)
CLKOUT
X2/CLKIN
tw(COL)
td(CIH-CO)
tf(CI)
tr(CI)
tc(CO)
tc(CI)
tw(COH)
tw(CIH)
tw(CIL)
Figure 53. External Divide-by-Two Clock Timing
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RSA06DTKH | CONN EDGECARD 12POS DIP .125 SLD |
| VJ1206Y681KBEAT4X | CAP CER 680PF 500V 10% X7R 1206 |
| 172-015-102R011 | CONN DB15 MALE SOLDER CUP TIN |
| BWR-15/670-D12A-C | CONV DC/DC +/-15V +/-670MA DIP |
| VJ1206Y682KBAAT4X | CAP CER 6800PF 50V 10% X7R 1206 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMS320VC5409ZGU100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Fixed-Pt Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| TMS320VC5409ZGU-80 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Fixed-Pt Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| TMS320VC5410AGGU1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Texas Instruments 功能描述: |
| TMS320VC5410AGGU12 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| TMS320VC5410AGGU16 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC Dig Signal Proc RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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