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參數(shù)資料
| 型號： | UPD30102S1-54-3C |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 163/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102S1-54-3C |
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CHAPTER 6 EXCEPTION PROCESSING
163
KX
: Enables 64-bit addressing in Kernel mode (0
o
32-bit, 1
o
64-bit). If this bit is set, an XTLB Refill
exception occurs if a TLB miss occurs in the Kernel mode address space.
: Enables 64-bit addressing and operation in Supervisor mode (0
o
32-bit, 1
o
64-bit). If this bit is
set, an XTLB Refill exception occurs if a TLB miss occurs in the Supervisor mode address space.
: Enables 64-bit addressing and operation in User mode (0
o
32-bit, 1
o
64-bit). If this bit is set, an
XTLB Refill exception occurs if a TLB miss occurs in the User mode address space.
: Sets and indicates the operating mode (10
o
User, 01
o
Supervisor, 00
o
Kernel).
: Sets and indicates the error level (0
o
Normal, 1
o
Error).
: Sets and indicates the exception level (0
o
Normal, 1
o
Exception).
: Sets and indicates interrupt enabling/disabling (0
o
Disabled, 1
o
Enabled).
SX
UX:
KSU
ERL
EXL
IE
Figure 6-6. Status Register Diagnostic Status Field
16
17
18
19
20
21
22
23
24
0
BEV
TS
SR
0
CH
CE
DE
1
1
1
1
1
1
1
2
BEV
: Specifies the base address of a TLB Refill exception vector and common exception vector (0
o
Normal, 1
o
Bootstrap).
: Occurs the TLB to be shut down (read-only) (0
o
Not shut down, 1
o
Shut down). This bit is used to
avoid any problems that may occur when multiple TLB entries match the same virtual address. After
the TLB has been shut down, reset the processor to enable restart. Note that the TLB is shut down
even if a TLB entry matching a virtual address is marked as being invalid (with the V bit cleared).
: Occurs a Soft Reset or NMI exception (0
o
Not occurred, 1
o
Occurred).
: CP0 condition bit (0
o
False, 1
o
True). This bit can be read and written by software only; it cannot
be accessed by hardware.
: When CE = 1, the contents of the PErr register are written to the check bits of the cache (See 6.3.10)
: Specifies whether a cache parity error causes an exception (0
o
Enable parity check, 1
o
Disable
parity check).
: Reserved for future use. Write 0 in a write operation. When this field is read, 0 is read.
TS
SR
CH
CE
DE
0
The status register has the following fields where the modes and access status are set.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD30550F2-400-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD4168 | 8,192 x 8-BIT NMOS XRAM |
| UPD4168C-15 | 8,192 x 8-BIT NMOS XRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
| UPD30121 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-131-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-168-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
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