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參數(shù)資料
| 型號： | UPD30102S1-54-3C |
| 廠商： | NEC Corp. |
| 英文描述： | 64/32-bit Microprocessor |
| 中文描述： | 64/32微處理器 |
| 文件頁數(shù)： | 210/701頁 |
| 文件大?。?/td> | 2329K |
| 代理商： | UPD30102S1-54-3C |
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CHAPTER 7 INITIALIZATION INTERFACE
210
7.4 V
R
4102 PROCESSOR MODES
The V
R
4102 supports various modes, which can be selected by the user. The CPU core mode is set each time a
write occurs in the Status register and Config register. The on-chip peripheral unit mode is set by writing to the I/O
register.
This section describes the CPU core’s operation modes. For operation modes of on-chip peripheral units, see the
chapters describing the various units.
7.4.1 Power Modes
The V
R
4102 supports four power modes: Fullspeed mode, Standby mode, Suspend mode, and Hibernate mode.
(1) Fullspeed Mode
This is the normal operation mode.
The V
R
4102’s default status sets operation under Fullspeed mode. After the processor is reset, the V
R
4102
returns to Fullspeed mode.
(2) Standby Mode
When a STANDBY instruction has been executed, the processor can be set to Standby mode. During Standby
mode, all of the internal clocks in the CPU core except for the timer and interrupt clocks are held at high level.
The peripheral units all operate as they do during Fullspeed mode. This means that DMA operations are
enabled during Standby mode.
When the STANDBY instruction completes the WB stage, the V
R
4102 remains idle until the SysAD internal bus
enters the idle state. Next, the clocks in the CPU core are shut down and pipeline operation is stopped.
However, the PLL, timer, and interrupt clocks continue to operate, as do the internal bus clocks (TClock and
MasterOut).
During Standby mode, the processor is returned to Fullspeed mode if any interrupt occurs, including a timer
interrupt that occurs internally.
(3) Suspend Mode
When the SUSPEND instruction has been executed, the processor can be set to Suspend mode. During
Suspend mode, the processor stalls the pipeline and supplying all of the internal clocks in the CPU core except
for PLL timer and interrupt clocks are stopped. The V
R
4102 stops supplying TClock to peripheral units.
Accordingly, during Suspend mode peripheral units can only be activated by a special interrupt unit (DCD#
control, etc.). While in this mode, the register and cache contents are retained.
When the SUSPEND instruction completes the WB stage, the V
R
4102 switches the DRAM to self refresh mode
and then waits for the SysAD internal bus to enter the idle state. Next, the clocks in the CPU core are shut down
and pipeline operation is stopped. The V
R
4102 then stops supplying TClock to peripheral units. However, the
PLL, timer, and interrupt clocks continue to operate, as do the MasterOut.
The processor remains in Suspend mode until an interrupt is received, at which time it returns to Fullspeed
mode.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD30102S1-66-3C | 64/32-bit Microprocessor |
| UPD30550F2-300-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD30550F2-400-NN1 | VR5500⑩ 64-/32-BIT MICROPROCESSOR |
| UPD4168 | 8,192 x 8-BIT NMOS XRAM |
| UPD4168C-15 | 8,192 x 8-BIT NMOS XRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD30102S1-66-3C | 制造商:NEC 制造商全稱:NEC 功能描述:64/32-bit Microprocessor |
| UPD30111S1-70-3C | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MICROPROCESSOR|32-BIT|CMOS|BGA|224PIN|PLASTIC |
| UPD30121 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-131-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
| UPD30121F1-168-GA1 | 制造商:NEC 制造商全稱:NEC 功能描述:VR4121TM 64-/32-BIT MICROPROCESSOR |
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