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參數(shù)資料
| 型號(hào)： | UPD703214GFA1-xxx-JBT |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁(yè)數(shù)： | 390/757頁(yè) |
| 文件大小： | 4410K |
| 代理商： | UPD703214GFA1-XXX-JBT |
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CHAPTER 9 8-BIT TIMERS H0 AND H1
User
’
s Manual U15862EJ3V0UD
390
Figure 9-9. Carrier Generator Mode (2/3)
Operation when CMPn0 = N, CMPn1 = M is set (operation with carrier clock phase asynchronous to NRZn phase)
N
L
CMPn0
CMPn1
TMHEn
INTTMHn
Carrier clock
TM5n count value
00H
N
00H 01H
M
00H
N
00H 01H
M
00H
00H
N
M
CR5n
TCE5n
TOHn
0
0
1
1
0
0
1
1
0
0
INTTM5n
NRZBn
NRZn
Carrier clock
00H 01H
L
00H 01H
L
00H 01H
L
00H 01H
00H 01H
L
<1> <2>
<3>
<4>
<5>
<6>
<7>
8-bit timer 5n count clock
8-bit timer Hn count clock
8-bit timer counter
Hn count value
<1> When TMHEn = 0 and TCE5n = 0, the operation of 8-bit timer Hn is stopped.
<2> When TMHEn = 1 is set, 8-bit timer Hn starts counting. The carrier clock is maintained inactive at this time.
<3> When the count value of 8-bit timer counter Hn and the value of the CMPn0 register match, the first INTTMHn
signal is generated, the carrier clock signal is inverted, and the register that is compared with 8-bit timer
counter Hn changes from the CMPn0 register to the CMPn1 register. 8-bit timer counter Hn is cleared to 00H.
<4> When the count value of 8-bit timer counter Hn and the value of the CMPn1 register match, the INTTMHn
signal is generated, the carrier clock signal is inverted, and the register that is compared with 8-bit timer
counter Hn changes from the CMPn1 register to the CMPn0 register. 8-bit timer counter Hn is cleared to 00H.
A carrier clock with a fixed duty ratio (other than 50%) is generated through the repetition of steps <3> and
<4>.
<5> The INTTM5n signal is generated. This signal is synchronized with 8-bit timer Hn and output as the
INTTM5Hn signal.
<6> When the carrier clock phase becomes asynchronous to the phase of the NRZn bit, the carrier is output from
the rising edge of the first carrier clock by setting NRZn = 1.
<7> By setting NRZn = 0, the TOHn output is also maintained high level while the carrier clock is high level, and
does not change to low level (the high level width of the carrier waveform is guaranteed through steps <6>
and <7>).
Remark
n = 0, 1
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