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參數(shù)資料
型號(hào)： XRT79L71IB
廠商： Exar Corporation
文件頁(yè)數(shù)： 114/609頁(yè)
文件大?。?/td> 0K
描述： IC LIU/FRAMER DS3/E3 1CH 208BGA
標(biāo)準(zhǔn)包裝： 126
控制器類(lèi)型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 208-LBGA
供應(yīng)商設(shè)備封裝： 208-STBGA（17x17）
包裝： 托盤(pán)
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XRT79L71
PRELIMINARY
185
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
It will generate the Change of LOL (Loss of Lock) Defect Condition Interrupt. The XRT79L71 will indicate
that it is generating this interrupt by (a) asserting the Interrupt Request output pin (by toggling it "Low"), and
(b) by setting Bit 2 (Change of LOL Condition Interrupt), within the LIU Interrupt Status Register, to "1" as
depicted below.
For the duration that the Clock and Data Recovery block is declaring the LOL Defect Condition then all of the
following will be true.
The Clock and Data Recovery block will be synthesizing a 44.736MHz clock signal that is derived from the
Reference clock signal (which originates from the SFM Synthesizer block).
The Clock and Data Recovery block will route this 44.736MHz clock signal to all down-stream circuitry (e.g.,
the Receive DS3/E3 Framer block, etc.). Each of these down-stream blocks will use this 44.736MHz clock
signal as their timing source.
The Clock and Data Recovery Block and its LOL Defect Declaration Behavior during Signal Present
and No Signal Present Conditions
Once the Clock and Data Recovery Block has declared the LOL Defect Condition, then any subsequent
behaviour of the Clock and Data Recovery Block, depends upon whether the AGC Block (within the Receive
DS3/E3 LIU Block) determines that some sort of signal energy is present (at the RTIP/RRING input pins) or
not.
If No Signal is present at the RTIP/RRING Input Pins
If the incoming DS3 line signal were to be removed, such that there is absolutely no signal energy being
applied to the RTIP/RRING input pins, then all of the following will happen.
The Receive DS3/E3 LIU Block will declare the LOS Defect Condition (please see Section 4.3.1.6 for more
information on how the Receive DS3/E3 LIU Block declares the LOS Defect Condition).
LIU Alarm Status Register (Address = 0x1303)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Digital LOS
Defect
Declared
Analog LOS
Defect
Declared
FL (FIFO
Limit) Alarm
Declared
Receive LOL
Defect
Declared
Receive LOS
Defect
Declared -
Receive
DS3/E3 LIU
Block
Transmit
DMO Condi-
tion
R/O
0
1
0
LIU Interrupt Status Register (Address = 0x1302)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Change of
FL
Condition
Interrupt
Status
Change of
LOL
Condition
Interrupt
Status
Change of
LOS
Condition
Interrupt
Status
Change of
DMO
Condition
Interrupt
Status
R/O
RUR
0
1
0
相關(guān)PDF資料
PDF描述
PIC24F08KL302T-I/SO IC MCU 16BIT 8KB FLASH 28-SOIC
XRT86VL34IB IC LIU/FRAMER T1/E1/J1 4CH 225BG
PIC24F08KL201T-I/MQ IC MCU 16BIT 8KB FLASH 20-QFN
XRT86VL32IB IC LIU/FRAMER T1/E1/J1 2CH 225BG
PIC16LF1933T-I/MV IC MCU 8BIT 7KB FLASH 28UQFN
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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XRT79L72 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L72IB 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73IB 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
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