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參數(shù)資料
| 型號： | 20726 |
| 英文描述： | 3DNow!? Technology Manual AMD-K6 Processor Multimedia Technology |
| 中文描述： | 3DNow??？技術(shù)手冊的AMD - K6處理器多媒體技術(shù) |
| 文件頁數(shù)： | 85/120頁 |
| 文件大小： | 1284K |
| 代理商： | 20726 |
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MMX Instruction Set
79
20726D/0—January 2000
AMD-K6 MMX Enhanced Processor Multimedia Technology
Preliminary Information
PSRLQ
mnemonic
opcode
description
PSRLQ mmreg1, mmreg2/mem64
0F D3h
Shift right logical 64-bit values in mmreg1 the number of
positions in mmreg2/mem64 with zero fill from the left
0F 73h /2 Shift right logical 64-bit values in mmreg1 the number of
positions in imm8 with zero fill from the left
PSRLQ mmreg1, imm8
Privilege:
Registers Affected:
Flags Affected:
Exceptions Generated:
none
MMX
none
The PSRLQ instruction shifts the 64-bit operand in the destination operand (an MMX
register) to the right by the number of bit positions indicated by mmreg2/mem64 or by
imm8, the 8-bit immediate operand. The shifted value is zero filled from the left. The
result is stored in the MMX register specified as the destination operand.
Exception
Invalid opcode (6)
Device not available (7)
Real
X
X
Virtual
8086
X
X
Protected Description
X
X
The emulate MMX instruction bit (EM) of the control register (CR0) is set to 1.
Save the floating-point or MMX state if the task switch bit (TS) of the control
register (CR0) is set to 1.
During instruction execution, the stack segment limit was exceeded.
During instruction execution, the effective address of one of the segment
registers used for the operand points to an illegal memory location.
One of the instruction data operands falls outside the address range 00000h
to 0FFFFh.
A page fault resulted from the execution of the instruction.
An exception is pending due to the floating-point execution unit.
Stack exception (12)
General protection (13)
X
X
Segment overrun (13)
X
X
Page fault (14)
Floating-point exception
pending (16)
Alignment check (17)
X
X
X
X
X
X
X
An unaligned memory reference resulted from the instruction execution,
and the alignment mask bit (AM) of the control register (CR0) is set to 1.
(In Protected Mode, CPL = 3.)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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