參數資料
型號: 28230-13
廠商: CONEXANT SYSTEMS
元件分類: 數字傳輸電路
英文描述: ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208
封裝: PLASTIC, MQFP-208
文件頁數: 156/237頁
文件大?。?/td> 3214K
代理商: 28230-13
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12
1.0 Product Description
1.2 Logic Diagram and Pin Descriptions
Bt8230
ATM Segmentation and Reassembly Controller—SAR
N8230DS1F
Lo
ca
lProc
e
ss
o
r
In
te
rfac
e
PROCMODE
Processor Mode Select
I
When grounded, this input selects the local processor mode.
When pulled to a logic high, the stand-alone mode is selected.
PADDR[1,0]
Word Select Inputs
I
The PADDR[1,0] inputs are connected to the word select field
of the CPU address bus (address bits [3, 2] for the Intel
i80960CA processor, which can perform 4-word burst trans-
actions). These inputs are used by the Bt8230 to allow single-
cycle bursts to be performed without requiring very short
memory access times.
PBSEL[1,0]
Bank Select Inputs
I
Selects one of four banks of memory to be accessed. They are
decoded by the memory controller to generate the appropriate
chip/bank selects to the external memory.
PBE[3:0]*
Write Byte Enable
I
Supply byte enables for each local processor memory access.
These pins are only relevant during writes by the local proces-
sor to local memory. Each byte enable line corresponds to a
specific byte lane in the LDATA[31:0] data bus: PBE[0]* corre-
sponds to LDATA[7:0], PBE[1]* to LDATA[15:8], PBE[2]* to
LDATA[23:16], and PBE[3]* to LDATA[31:24].
PCS*
(PHYCS1*)
SRC Chip Select
ATM PHY Chip Select
(in stand-alone mode)
I/O
In local processor mode with PROCMODE tied low, PCS* is
the SRC chip select input. In stand-alone mode, this pin is
PHYCS1*, which may be connected to the chip select input of
the Bt8222 Physical Device (PHY) device.
Table 1-1. Hardware Signal Definitions (5 of 7)
Pin Label
Signal Name
I/O
Definition
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PDF描述
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參數描述
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