參數(shù)資料
型號(hào)： 28230-13
廠(chǎng)商： CONEXANT SYSTEMS
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208
封裝： PLASTIC, MQFP-208
文件頁(yè)數(shù)： 180/237頁(yè)
文件大?。?/td> 3214K
代理商： 28230-13
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3.0 Functional Description
3.3 Local Processor Interface
Bt8230
ATM Segmentation and Reassembly Controller—SAR
N8230DS1F
3.3 Local Processor Interface
The Bt8230 integrated circuit can be used in conjunction with an external proces-
sor that performs initialization, link management, monitoring, and control func-
tions. The local processor interface consists of a “l(fā)oosely coupled” architecture
where it interfaces to the Bt8230 through bidirectional transceivers and buffers
that are controlled by the local processor and the Bt8230, as shown in Figure 3-9.
This architecture allows the processor access to all of the Bt8230 local SRAM
memory and control registers, while insulating the Bt8230 from processor
instruction and data cache fills. This also allows the local processor the option to
control multiple Bt8230 and/or physical interface devices.
The processor interface is a generic synchronous interface based on the Intel
i960CA 32-bit architecture, and is completely compatible with the i960CA/CF
and the new i960Jx processors. Other synchronous and asynchronous processors
(e.g., from Motorola, AMD, IDT) can be interfaced using external circuitry. The
only requirements are that the processor have a 32-bit bus and that the control sig-
nals be synchronized to the System Clock (SYSCLK).
To access the Bt8230 local memory or control registers, the processor must
arbitrate with the Bt8230 for access to the memory controller. Due to the require-
ments of reassembly and segmentation access to SRAM, and the implications of
PCI bus utilization, the local processor has the lowest priority in the memory arbi-
tration scheme. Since the local processor is typically used for low bandwidth
supervision and maintenance functions, this should be acceptable.
When the local processor accesses the Bt8230’s control registers or local
memory, a local processor memory request is generated within the Bt8230. The
memory arbiter then coordinates this request with requests from other memory
Figure 3-9. Bt8230—Local Processor Interface
1Required to address full 8 MByte range, typically fewer address lines are used.
2Required for non-i960 processors.
Dir
Data
Data Enable
Dir
/OE
x32 Xcvr
/OE
Address
x17 Buff1
Local Processor
Bt8230
High Address
Decode
Chip Select
Control
Status
Control
Status
Optional
Clock
Logic2
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