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參數(shù)資料
| 型號(hào)： | 28230-13 |
| 廠商： | CONEXANT SYSTEMS |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208 |
| 封裝： | PLASTIC, MQFP-208 |
| 文件頁(yè)數(shù)： | 23/237頁(yè) |
| 文件大?。?/td> | 3214K |
| 代理商： | 28230-13 |
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3.0 Functional Description
3.6 ATM Physical Interface
Bt8230
ATM Segmentation and Reassembly Controller—SAR
N8230DS1F
3.6.8 Receive Cell Synchronization Logic
The receive cell synchronization logic accepts a stream of octets (together with
error and cell boundary indications) from the receive ATM physical interface and
performs the following functions:
Maintains a sequence counter that marks the various components of an
ATM cell: the 5-byte ATM header, the 1-byte HEC field within the header
and the 48-byte payload. The sequence counter is also used by the ATM
physical interface to check cell boundary synchronization. When the
sequence counter wraps to 0 it should coincide with the RXMARK (SOC)
signal. If not, then a framing error occurs.
Extracts and discards the HEC byte from each 53-byte ATM cell, leaving
52 bytes of cell data.
Formats consecutive 4-byte segments into 32-bit words. Thus, the header
forms the first word, the first 4 bytes of the payload form the next word,
and so on. A total of 13 32-bit words are created from each 52-byte cell
after the HEC byte has been removed. The bytes within each word are left-
justified (big-endian format); i.e., the first byte received is the most signif-
icant byte of the word.
Ensures that a complete cell (exactly 52 bytes) is always written to the
FIFO. If a synchronization error occurs, the FR_SYNC_ERR bit in the
HOST_ISTAT0/LP_ISTAT0 registers is set. The ATM physical interface
attempts to resynchronize with the data stream. If this error occurs in
UTOPIA mode, the cell is placed in the FIFO. If it occurs in 8222 mode,
the cell is not placed in the FIFO.
Sets the RSM_OVFL bit in the HOST_ISTAT0/LP_ISTAT0 registers if an
octet could not be transferred due to the receive FIFO being full.
RSM_OVFL will not occur when using UTOPIA modes since RXENA is
not asserted unless there is room in the RxFIFO.
3.6.9 Transmit Cell Synchronization Logic
The transmit cell synchronization logic copies cell data from the transmit cell
FIFO to the transmit ATM physical interface while performing the following
functions:
Reads 32-bit words from the transmit cell FIFO and converts them to a
stream of octets, with the most significant byte of each 32-bit word corre-
sponding to the first byte derived from that word (big-endian format).
Maintains a sequence counter that delineates the various components of
each ATM cell (4-byte header, 48-byte payload) in the outgoing byte stream.
Inserts a blank (all-zero) HEC byte, used as a placeholder, into the outgo-
ing byte stream representing each ATM cell. The HEC placeholder is
inserted after the first 4 bytes (the ATM header) have been transferred. In
Bt8222 mode, the Bt8222 device will calculate and insert the correct HEC
value.
Generates appropriate cell delineation pulses to the transmit ATM physical
interface logic, for use in generating the TXMARK* output and also in
verifying synchronization with the framer device.
If the ATM physical transmit interface runs out of cells to transmit, the
SEG_UNFL bit is set in the HOST_ISTAT0/LP_ISTAT0 registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| 282-302 | 制造商:WAGO Innovative Connections 功能描述:END PLATE, RAIL MOUNTED TERMINAL BLOCK; Series:-; Accessory Type:End Plate; For Use With:Rail Mounted Terminal Blocks ;RoHS Compliant: Yes |
| 282302-000 | 功能描述:CABLE 1 COND 12AWG SHIELDED RoHS:是 類別:線纜，導(dǎo)線 >> 單芯導(dǎo)線 系列:- 產(chǎn)品培訓(xùn)模塊:Basics of Wire and Cable 產(chǎn)品目錄繪圖:Stranded Hook Up Wire 標(biāo)準(zhǔn)包裝:1 系列:3070 纜線類型:電子線 線規(guī):24 AWG 線束:7/32 長(zhǎng)度:100' (30.5m) 套管類型:聚氯乙烯（PVC） 套管直徑:0.088"（2.24mm） 套管（絕緣體）厚度:0.032"（0.81mm） 電壓:600V 工作溫度:-20°C ~ 105°C 顏色:藍(lán) 特點(diǎn):UL 1015 型 線芯:1 其它名稱:3070 BK005 BLUEA3070L-100 |
| 282304-2 | 制造商:TE Connectivity 功能描述:AMP MODU II RCPT HSG - Bag |
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