參數(shù)資料
型號(hào)： 28230-13
廠商： CONEXANT SYSTEMS
元件分類(lèi)： 數(shù)字傳輸電路
英文描述： ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208
封裝： PLASTIC, MQFP-208
文件頁(yè)數(shù)： 38/237頁(yè)
文件大?。?/td> 3214K
代理商： 28230-13
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117
4.0 Registers
4.1 General Purpose Registers
Bt8230
ATM Segmentation and Reassembly Controller—SAR
N8230DS1F
4.1.4 0x14—Configuration Register 0 (CONFIG0)
Access types: R/W B, L
Configuration Register 0 is located at address 0x14. This register provides all of
the control and configuration bits that are not associated with the reassembly and
segmentation coprocessors. The majority of these bits are configuration (which
occurs at initialization time) and are not changed dynamically. The assertion of
the HRST* system reset pin will clear all of the bits in the CONFIG0 register
except for MEMCTRL, which will be set high.
Bit
Field
Size
Name
Description
31
1
LP_ENABLE
When set, this bit causes the PRST* output pin to be high. This may be used
to reset the local processor.
30
1
GLOBAL_RESET
When set, this bit causes reset of the segmentation and reassembly copro-
cessors as well as all latched status.
29
1
PCI_MSTR_RESET
When set, this bit resets the PCI master logic. Once active, this bit must stay
active for 16 cycles of the HCLK input signal.
28–26
3
Reserved
Always set to zero.
25
1
LP_LOCK
When set, this bit disables write access by the host to Bt8230 registers and
local memory, with the exception of the LP_MBOX and HOST_IMASK0 regis-
ters. Read accesses are not affected. This bit cannot be set by the host pro-
cessor, nor can it be set if the HOST_LOCK bit is active.
24
1
HOST_LOCK
When set, this bit disables write access by the local processor to SRC regis-
ters and local memory, with the exception of the HOST_MBOX and
LP_IMASK0 registers. Read accesses are not affected. This bit cannot be set
by the local processor. This bit cannot be set if the LP_LOCK bit is active.
23
1
Reserved
Always set to zero.
22
1
PCI_READ_MULTIPLE
When this bit is set, PCI Master implements the PCI Read Multiple Command.
Otherwise, the PCI Master implements the PCI Read Command.
21
1
PHY2_EN
Enables the generation of the PHYCS2* signal.
20
1
PCI_ARB
Selects PCI master arbitration scheme. When a logic high, it enables round-
robin between read and write requests. When a logic low, reads have priority
over writes.
19–16
4
STATMODE[3:0]
Selects which internal status to output on the STAT[1,0] output pins (see
15
1
FR_RMODE
Controls reassembly start of cell processing. When set low, processing starts
after the first two words of a cell are received. When set high, a complete cell
must be in the reassembly FIFO before the cell is processed.
NOTE:
In 8222 mode, this bit must be set high because if there is a synch
error, the entire cell is discarded (FIFO write pointer is backed up). In
UTOPIA mode, the cell is accumulated into the FIFO in spite of the
synch error.
14
1
FR_LOOP
When set, this bit enables loopback of cells at the ATM physical interface. In
Rev. A, the loopback mode only worked when the PHY interface was config-
ured in UTOPIA mode, not Bt8222 mode. In Rev.B and higher, the loopback
mode works in either configuration.
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282-302 制造商:WAGO Innovative Connections 功能描述:END PLATE, RAIL MOUNTED TERMINAL BLOCK; Series:-; Accessory Type:End Plate; For Use With:Rail Mounted Terminal Blocks ;RoHS Compliant: Yes
282302-000 功能描述:CABLE 1 COND 12AWG SHIELDED RoHS:是 類(lèi)別:線纜，導(dǎo)線 >> 單芯導(dǎo)線 系列:- 產(chǎn)品培訓(xùn)模塊:Basics of Wire and Cable 產(chǎn)品目錄繪圖:Stranded Hook Up Wire 標(biāo)準(zhǔn)包裝:1 系列:3070 纜線類(lèi)型:電子線 線規(guī):24 AWG 線束:7/32 長(zhǎng)度:100' (30.5m) 套管類(lèi)型:聚氯乙烯（PVC） 套管直徑:0.088"（2.24mm） 套管（絕緣體）厚度:0.032"（0.81mm） 電壓:600V 工作溫度:-20°C ~ 105°C 顏色:藍(lán) 特點(diǎn):UL 1015 型 線芯:1 其它名稱(chēng):3070 BK005 BLUEA3070L-100
282304-2 制造商:TE Connectivity 功能描述:AMP MODU II RCPT HSG - Bag
28230-439-C 制造商:Schroff/Pentair Electronic Packaging 功能描述:
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