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參數資料
| 型號： | ADSP-2105BPZ-80 |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 40/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CONTROLLER 16BIT 68PLCC |
| 標準包裝： | 19 |
| 系列： | ADSP-21xx |
| 類型： | 定點 |
| 接口： | 同步串行端口（SSP） |
| 時鐘速率： | 20MHz |
| 非易失內存： | 外部 |
| 芯片上RAM： | 3kB |
| 電壓 - 輸入/輸出： | 5.00V |
| 電壓 - 核心： | 5.00V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應商設備封裝： | 68-PLCC（24.23x24.23） |
| 包裝： | 管件 |
| 產品目錄頁面： | 738 (CN2011-ZH PDF) |
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ADSP-21xx
REV. B
–45–
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tCK
CLKIN Period
97.6
150
ns
tCKL
CLKIN Width Low
20
ns
tCKH
CLKIN Width High
20
ns
tRSP
RESET Width Low
488
5tCK
1
ns
Switching Characteristic:
tCPL
CLKOUT Width Low
38.8
0.5tCK – 10
ns
tCPH
CLKOUT Width High
38.8
0.5tCK – 10
ns
tCKOH
CLKIN High to CLKOUT High
0
20
ns
NOTES
1Applies after powerup sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator startup time).
TIMING PARAMETERS (ADSP-2103/2162/2164)
CLOCK SIGNALS & RESET
Figure 39. Clock Signals
CLKIN
CLKOUT
t
CKH
t
CK
t
CKL
t
CKOH
t
CPH
t
CPL
相關PDF資料 |
PDF描述 |
|---|---|
| EEM06DTMH | CONN EDGECARD 12POS R/A .156 SLD |
| HSC40DRTF-S13 | CONN EDGECARD 80POS .100 EXTEND |
| XC95288XL-7FG256C | IC CPLD 288 MCELL C-TEMP 256FBGA |
| VI-B7L-CX-B1 | CONVERTER MOD DC/DC 28V 75W |
| TAP336J010CRW | CAP TANT 33UF 10V 5% RADIAL |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ADSP-2105BPZ-80 | 制造商:Analog Devices 功能描述:IC 16-BIT MICROCOMPUTER |
| ADSP-2105BPZ-80RL | 制造商:Analog Devices 功能描述: |
| ADSP-2105KP-40 | 制造商:Analog Devices 功能描述:Digital Signal Processor, 16 Bit, 68 Pin, Plastic, PLCC |
| ADSP2105KP55 | 制造商:AD 功能描述:* |
| ADSP-2105KP-55 | 制造商:Analog Devices 功能描述:SEMICONDUCTOR ((NW)) |
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