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參數(shù)資料
| 型號(hào)： | AM79C961AVCW |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | PCnet⑩-ISA II Jumperless, Full Duplex Single-Chip Ethernet Controller for ISA |
| 中文描述： | 2 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP144 |
| 封裝： | TQFP-144 |
| 文件頁數(shù)： | 145/206頁 |
| 文件大?。?/td> | 1507K |
| 代理商： | AM79C961AVCW |
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Am79C961A
145
SWITCHING CHARACTERISTICS: EADI (Unless otherwise noted, parametric values are
the same between Commercial devices and Industrial devices)
Note:
External Address Detection interface is invoked by setting bit 3 in ISACSR2 and resetting bit 0 in ISACSR2. External MAU select
is not available when EADISEL bit is set.
SWITCHING CHARACTERISTICS: JTAG (IEEE 1149.1) INTERFACE (Unless otherwise
noted, parametric values are the same between Commercial devices and Industrial
devices)
Note:
JTAG logic is reset with an internal Power-On Reset circuit independent of Sleep Modes.
Parameter
Symbol
Parameter Description
Test Conditions
Min
Max
Unit
t
EAD1
SRD Setup to
↑
SRDCLK
40
ns
t
EAD2
SRD Hold to
↑
SRDCLK
40
ns
t
EAD3
SF
/
BD Change to
↓
SRDCLK
–
15
+15
ns
t
EAD4
EAR Deassertion to
↑
SRDCLK
(First Rising Edge)
50
ns
t
EAD5
EAR Assertion from SFD Event
(Packet Rejection)
0
51,090
ns
t
EAD6
EAR Assertion
110
ns
Parameter
Symbol
Parameter Description
Test Conditions
Min
Max
Unit
t
JTG1
TCK HIGH Assertion
20
ns
t
JTG2
TCK Period
100
ns
t
JTG3
TDI Setup to
↑
TCK
5
ns
t
JTG4
TDI, TMS Hold from
↑
TCK
5
ns
t
JTG5
TMS Setup to
↑
TCK
8
ns
t
JTG6
TDO Active from
↓
TCK
0
30
ns
t
JTG7
TDO Change from
↓
TCK
0
30
ns
t
JTG8
TDO Tristate from
↓
TCK
0
25
ns
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PDF描述 |
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