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參數資料
| 型號： | AM79C978 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | Single-Chip 1/10 Mbps PCI Home Networking Controller |
| 中文描述： | 單芯片的1 / 10 Mbps的家庭網絡控制器的PCI |
| 文件頁數： | 127/261頁 |
| 文件大?。?/td> | 3803K |
| 代理商： | AM79C978 |
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Am79C978
127
CSR15: Mode
This register
’
s fields are loaded during the Am79C978
controller initialization routine with the corresponding
Initialization Block values, or when a direct register write
has been performed on this register.
Bit
Name
Description
31-16
RES
Reserved locations. Written as
zeros and read as undefined.
15
PROM
Promiscuous
PROM = 1, all incoming receive
frames are accepted.
Mode.
When
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
14
DRCVBC
Disable
When
Am79C978 controller from re-
ceiving broadcast messages.
Used for protocols that do not
support broadcast addressing,
except as a function of multicast.
DRCVBC is cleared by activation
of
H_RESET
(broadcast messages will be re-
ceived) and is unaffected by
STOP.
Receive
set,
Broadcast.
disables
the
or
S_RESET
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
13
DRCVPA
Disable Receive Physical Ad-
dress. When set, the physical ad-
dress detection (Station or node
ID) of the Am79C978 controller
will be disabled. Frames ad-
dressed to the nodes individual
physical address will not be rec-
ognized.
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
12-9
RES
Reserved locations. Written as
zeros and read as undefined.
8-7 PORTSEL[1:0] Port Select bits allow for software
controlled selection of the net-
work medium. The only legal val-
ues for this field is 11.
This bit is read/write accessible
only when either the STOP or the
SPND bit is set. Cleared by
H_RESET or S_RESET and is
unaffected by STOP.
6
INTL
Internal Loopback. See the de-
scription of LOOP (CSR15, bit 2).
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
5
DRTY
Disable Retry. When DRTY is set
to 1, the Am79C978 controller will
attempt only one transmission. In
this mode, the device will not pro-
tect the first 64 bytes of frame
data in the Transmit FIFO from
being overwritten, because auto-
matic retransmission will not be
necessary. When DRTY is set to
0, the Am79C978 controller will
attempt 16 transmissions before
signaling a retry error.
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
4
FCOLL
Force Collision. This bit allows
the collision logic to be tested.
The Am79C978 controller must
be in internal loopback for FCOLL
to be valid. If FCOLL = 1, a colli-
sion will be forced during loop-
back
transmission
which will result in a Retry Error.
If FCOLL = 0, the Force Collision
logic will be disabled. FCOLL is
defined after the initialization
block is read.
attempts,
This bit is read/write accessible
only when either the STOP or the
SPND bit is set.
3
DXMTFCS
Disable Transmit CRC (FCS).
When DXMTFCS is set to 0, the
transmitter will generate and ap-
pend an FCS to the transmitted
frame. When DXMTFCS is set to
1, no FCS is generated or sent
with
the
transmitted
DXMTFCS is overridden when
ADD_FCS and ENP bits are set
in TMD1.
frame.
When the APAD_XMT bit (CSR4,
bit11) is set to 1, the setting of
DXMTFCS has no effect.
相關PDF資料 |
PDF描述 |
|---|---|
| AM79C981 | Integrated Multiport Repeater Plus⑩ (IMR+⑩) |
| AM79C981JC | Integrated Multiport Repeater Plus⑩ (IMR+⑩) |
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| AM79C982-4JC | basic Integrated Multiport Repeater (bIMR) |
| AM79C982-8JC | basic Integrated Multiport Repeater (bIMR) |
相關代理商/技術參數 |
參數描述 |
|---|---|
| AM79C978A | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Single-Chip 1/10 Mbps PCI Home Networking Controller |
| AM79C978AKC\\W | 制造商:Advanced Micro Devices 功能描述: |
| AM79C978AKC\W | 制造商:Advanced Micro Devices 功能描述: |
| AM79C978AKCW | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Single-Chip 1/10 Mbps PCI Home Networking Controller |
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