參數(shù)資料
型號(hào)： CY3950V484-125BBC
廠商： Cypress Semiconductor Corp.
英文描述： CPLDs at FPGA Densities
中文描述： CPLD器件在FPGA的密度
文件頁(yè)數(shù)： 18/86頁(yè)
文件大?。?/td> 1212K
代理商： CY3950V484-125BBC
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 25 of 86
Switching Waveforms (continued)
Registered Output with Synchronous Clocking (Macrocell)
tMCS
INPUT
SYNCHRONOUS
tMCCO
REGISTERED
OUTPUT
tMCH
CLOCK
Registered Input in I/O Cell
tIOS
DATA
INPUT
INPUT REGISTER
CLOCK
tIOCO
REGISTERED
OUTPUT
tIOH
Clock to Clock
INPUT REGISTER
CLOCK
MACROCELL
REGISTER CLOCK
tSCS
tICS
PT Clock to PT Clock
DATA
PT CLOCK
tSCS2PT
tMCSPT
INPUT
相關(guān)PDF資料
PDF描述
CY54FCT540CTDMB FCT SERIES, 8-BIT DRIVER, INVERTED OUTPUT, CDIP20
CY54FCT543CTDMB FCT SERIES, 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, CDIP24
CY54FCT543ATDMB FCT SERIES, 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, CDIP24
CY54FCT543ATLMB FCT SERIES, 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, CQCC28
CY54FCT543TLMB FCT SERIES, 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, CQCC28
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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