(VDD = 1.8V ±10%; V
參數(shù)資料
型號: DS3105LN+
廠商: Maxim Integrated Products
文件頁數(shù): 21/124頁
文件大小: 0K
描述: IC TIMING LINE CARD 64-LQFP
產(chǎn)品培訓(xùn)模塊: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝: 160
類型: 定時卡 IC,多路復(fù)用器
PLL:
主要目的: 以太網(wǎng),SONET/SDH,Stratum,電信
輸入: CMOS,LVDS,LVPECL,TTL
輸出: CMOS,LVDS,LVPECL,TTL
電路數(shù): 1
比率 - 輸入:輸出: 5:2
差分 - 輸入:輸出: 無/是
頻率 - 最大: 312.5MHz
電源電壓: 1.62 V ~ 1.98 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 64-LQFP
供應(yīng)商設(shè)備封裝: 64-LQFP(10x10)
包裝: 托盤
DS3105
117
10.6 Reset Pin Timing
Table 10-12. Reset Pin Timing
(VDD = 1.8V ±10%; VDDIO = 3.3V ±5%, TA = -40°C to +85°C.) (See Figure 10-6.)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
RST Low Time (Note 1)
t1
1000
ns
SONSDH, SRCSW, O3F[2:0], O6F[2:0] Setup Time to
RST
t2
0
ns
SONSDH, SRCSW, O3F[2:0], O6F[2:0] Hold Time from
RST
t3
50
ns
Note 1:
RST should be held low while the REFCLK oscillator stabilizes. It is recommended to force RST low during power-up. The
1000ns minimum time applies if the
RST pulse is applied any time after the device has powered up and the oscillator has
stabilized.
Figure 10-6. Reset Pin Timing Diagram
RST
SONSDH
OxF[2:0]
SRCSW
VALID
X
t2
t3
t1
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PDF描述
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