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參數(shù)資料
| 型號： | DSM2150F5V-12T6 |
| 廠商： | 意法半導(dǎo)體 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | DSM (Digital Signal Processor System Memory) for Analog Devices DSPs (3.3V Supply) |
| 中文描述： | 帝斯曼（數(shù)字信號處理器系統(tǒng)內(nèi)存）的ADI公司的DSP（3.3V電源） |
| 文件頁數(shù)： | 58/73頁 |
| 文件大小： | 1067K |
| 代理商： | DSM2150F5V-12T6 |
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DSM2150F5V
58/73
Figure 29. Asynchronous Reset / Preset
Figure 30. Asynchronous Clock Mode Timing (Product Term Clock)
Table 24. CPLD MicroCell Asynchronous Clock Mode Timing
Symbol
Parameter
Conditions
-12
PT
Aloc
Turbo
Off
Slew
Rate
Unit
Min
Max
f
MAXA
Maximum Frequency
External Feedback
1/(t
SA
+t
COA
)
20.8
MHz
Maximum Frequency
Internal Feedback (f
CNTA
)
1/(t
SA
+t
COA
–
10)
26.3
MHz
Maximum Frequency
Pipelined Data
1/(t
CHA
+t
CLA
)
30.3
MHz
t
SA
Input Setup Time
10
Add 4
Add 20
ns
t
HA
Input Hold Time
12
ns
t
CHA
Clock High Time
18
Add 20
ns
t
CLA
Clock Low Time
15
Add 20
ns
t
COA
Clock to Output Delay
38
Add 20
Sub 6
ns
t
ARD
CPLD Array Delay
Any MicroCell
27
Add 4
ns
t
MINA
Minimum Clock Period
1/f
CNTA
38
ns
tARP
REGISTER
OUTPUT
tARPW
RESET/PRESET
INPUT
AI02864
tCHA
tCLA
tCOA
tHA
tSA
CLOCK
INPUT
REGISTERED
OUTPUT
AI02859
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PDF描述 |
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