參數資料
型號: IDTSSTE32882HLBAKG8
廠商: IDT, Integrated Device Technology Inc
文件頁數: 34/73頁
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描述: IC REGISTERING CLK DRIVER 176BGA
標準包裝: 1
類型: 時鐘緩沖器/驅動器,多路復用器
PLL:
主要目的: 存儲器,DDR3,RDIMM
輸入: CMOS
輸出: CMOS
電路數: 1
比率 - 輸入:輸出: 5:60
差分 - 輸入:輸出: 是/是
頻率 - 最大: 810MHz
電源電壓: 1.282 V ~ 1.575 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 176-TFBGA
供應商設備封裝: 176-CABGA(13.5x8)
包裝: 標準包裝
其它名稱: 800-2597-6
1.35V/1.5V REGISTERING CLOCK DRIVER WITH PARITY TEST AND QUAD CHIP SELECT
4
SSTE32882HLB
7201/14
SSTE32882HLB
1.35V/1.5V REGISTERING CLOCK DRIVER WITH PARITY TEST AND QUAD CHIP SELECT
COMMERCIAL TEMPERATURE
Block Diagram - Parity Logic Diagram (Positive Logic)
1 DCS[n:0] indicates all of the chip select inputs, where n=1 for QuadCS disabled, and n=3 for QuadCS enabled. QxCS[n:0]
indicates all of the chip select outputs.
Internal Logic
DCKE0,
DCKE1
DODT0,
DODT1
RESET
CK
FBIN
PLL
D
R
Q
D
R
Q
FBOUT
Y3
Y1
Y0
Y2
Y1
Y0
Internal Logic
QACKEn
QBCKEn
QAODTn
QBODTn
10K
- 100K
VREF
DA0..DA15,
DBA0..DBA2,
DRAS, DCAS,
DWE
PAR_IN
DCS[n:0]
D
R
Q
D
R
Q
D
R
Q
Internal Logic
QA0..QA15,
QBA0..QBA2,
QRAS, QCAS,
QWE
ERROUT
QxCS[n:0]
CE
Parity Generator
and
Error Check
DRAS
DCAS
DWE
Output Inversion Disabled
3T Timing Enabled
CS Logic
(1)
相關PDF資料
PDF描述
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參數描述
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IDTSSTUB32866BHLF 功能描述:IC BUFFER 25BIT CONF REG 96LFBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:- 特色產品:NXP - I2C Interface 標準包裝:1 系列:- 應用:2 通道 I²C 多路復用器 接口:I²C,SM 總線 電源電壓:2.3 V ~ 5.5 V 封裝/外殼:16-TSSOP(0.173",4.40mm 寬) 供應商設備封裝:16-TSSOP 包裝:剪切帶 (CT) 安裝類型:表面貼裝 產品目錄頁面:825 (CN2011-ZH PDF) 其它名稱:568-1854-1