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參數(shù)資料
| 型號(hào)： | KM48S2020C |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 1M x 8Bit x 2 Banks Synchronous DRAM(1M x 8位 x 2組同步動(dòng)態(tài)RAM) |
| 中文描述： | 1M × 8位× 2銀行同步DRAM（1米× 8位× 2組同步動(dòng)態(tài)RAM）的 |
| 文件頁數(shù)： | 38/44頁 |
| 文件大?。?/td> | 605K |
| 代理商： | KM48S2020C |
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TIMING DIAGRAM - I
CMOS SDRAM
ELECTRONICS
REV. 4 Nov. '97
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Clock Suspension & DQM Operation Cycle @CAS Latency=2, Burst Length=4
Row Active
Clock
Suspension
Read
Write
DQM
: Don't care
Clock
Suspension
Read
*Note 1
tSHZ
tSHZ
Write
DQM
Write
Read DQM
*Note :
1. DQM is needed to prevent bus contention.
BA
DQ
ADDR
CAS
RAS
CS
CKE
CLOCK
WE
DQM
A
10
/AP
Ra
Ca
Cb
Cc
Dc2
Dc0
Qb1
Qb0
Qa3
Qa2
Qa1
Qa0
Ra
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| KM48S8020B | 4M x 8Bit x 2 Banks Synchronous DRAM(4M x 8位 x 2組同步動(dòng)態(tài)RAM) |
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| KM48S8030 | 2M x 8Bit x 4 Banks Synchronous DRAM |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| KM48S8030C | 制造商:SAMSUNG 制造商全稱:Samsung semiconductor 功能描述:2M x 8Bit x 4 Banks Synchronous DRAM |
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