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參數(shù)資料
| 型號(hào)： | M58WR064KU70ZA6U |
| 廠商： | NUMONYX |
| 元件分類： | PROM |
| 英文描述： | 4M X 16 FLASH 1.8V PROM, 70 ns, PBGA44 |
| 封裝： | 7.50 X 5 MM, 0.50 MM PITCH, ROHS COMPLIANT, VFBGA-44 |
| 文件頁(yè)數(shù)： | 85/122頁(yè) |
| 文件大?。?/td> | 2187K |
| 代理商： | M58WR064KU70ZA6U |
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M58WRxxxKU, M58WRxxxKL
DC and AC parameters
65/123
Table 24.
Asynchronous Read AC characteristics
Symbol
Alt
Parameter
70
Unit
Re
ad
Ti
mi
ngs
tAVAV
tRC
Address Valid to Next Address Valid
Min
70
ns
tAVQV
tACC
Address Valid to Output Valid (Random)
Max
70
ns
tELTV
Chip Enable Low to Wait Valid
Max
11
ns
tELQV
(1)
1.
G may be delayed by up to tELQV - tGLQV after the falling edge of E without increasing tELQV.
tCE
Chip Enable Low to Output Valid
Max
70
ns
tEHTZ
Chip Enable High to Wait Hi-Z
Max
14
ns
tEHQX
(2)
2.
Sampled only, not 100% tested.
tOH
Chip Enable High to Output Transition
Min
0
ns
tEHQZ
tHZ
Chip Enable High to Output Hi-Z
Max
14
ns
tGLQV
tOE
Output Enable Low to Output Valid
Max
20
ns
tGLQX
tOLZ
Output Enable Low to Output Transition
Min
0
ns
tGHQX
tOH
Output Enable High to Output Transition
Min
0
ns
tGHQZ
tDF
Output Enable High to Output Hi-Z
Max
14
ns
Latch
Timin
g
s
tAVLH
tAVADVH
Address Valid to Latch Enable High
Min
7
ns
tELLH
tELADVH
Chip Enable Low to Latch Enable High
Min
10
ns
tLHAX
tADVHAX
Latch Enable High to Address Transition
Min
7
ns
tLLLH
tADVLADVH Latch Enable Pulse Width
Min
7
ns
tLLQV
tADVLQV
Latch Enable Low to Output Valid (Random)
Max
70
ns
tLHGL
tADVHGL
Latch Enable High to Output Enable Low
Min
5
ns
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