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參數(shù)資料
| 型號： | MB-91110PMT2 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 50 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 124/452頁 |
| 文件大?。?/td> | 6219K |
| 代理商： | MB-91110PMT2 |
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xvii
TABLES
Table 1.2-1
Models of MB91110 ................................................................................................................... 6
Table 1.6-1
Explanations of the Pin Functions ............................................................................................ 10
Table 1.7-1
I/O Circuit Types ...................................................................................................................... 17
Table 3.3-1
Cache Status in Each Operation Mode .................................................................................... 37
Table 3.3-2
Cache Entry Update ................................................................................................................. 38
Table 3.10-1
Interrupt Levels .......................................................................................................................... 60
Table 3.10-2
Interrupt Sources and Vectors .................................................................................................. 62
Table 3.10-3
Vector Table ............................................................................................................................. 66
Table 3.10-4
Priorities of EIT Sources and the Masking Levels of Other Sources ........................................ 68
Table 3.10-5
EIT Handler Execution Order ................................................................................................... 69
Table 3.12-1
Watchdog Cycles Specified by WT1 and WT0 ......................................................................... 77
Table 3.12-2
CPU machine clock cycles ....................................................................................................... 79
Table 3.12-3
Peripheral machine clock cycles .............................................................................................. 80
Table 3.12-4
Watchdog Cycles Specified by WT1 and WT0 ......................................................................... 82
Table 3.12-5
Combinations of Operating Frequencies by Clock Doubler Function On/Off
.......................... 95
Table 3.13-1
Operations in Low-power Consumption Mode ....................................................................... 101
Table 3.13-2
Oscillation Stabilization Wait Times Specified by OSC1 and OSC0 ...................................... 102
Table 3.14-1
Mode Pins and Set Modes ..................................................................................................... 110
Table 3.14-2
Bus Mode Setting Bits and Other Bits ................................................................................... 111
Table 4.1-1
Chip Select Areas and Selectable Interface Functions .......................................................... 115
Table 4.3-1
DRAM Page Sizes to be Connected ...................................................................................... 128
Table 4.3-2
Combinations of Bus Widths Available in Areas 4 and 5 ........................................................ 130
Table 4.3-3
Mode Settings by the Combinations of Bits LE2 to LE0 ......................................................... 138
Table 4.4-1
Relationships between Data Bus Widths and Control Signals ............................................... 141
Table 4.4-2
DRAM Control Pin Functions and Data Bus Areas ................................................................ 156
Table 4.4-3
Page Size Selection Bits
....................................................................................................... 157
Table 5.4-1
External Pin Functions ............................................................................................................ 207
Table 6.3-1
Clock Source Setting Using the CSL Bits ............................................................................... 215
Table 6.3-2
Settings of the MOD2 to MOD0 Bits (1) ................................................................................. 216
Table 6.3-3
Settings of the MOD2 to MOD0 Bits (2) ................................................................................. 216
Table 6.3-4
Settings of the OUTE, RELD, and OUTL Bits ........................................................................ 216
Table 7.3-1
Counter Clock Selection ......................................................................................................... 230
Table 7.3-2
Effective Edge Selection for External Trigger Input (TRG) ..................................................... 230
Table 7.3-3
Selection of Interrupt Resource .............................................................................................. 231
Table 8.2-1
Allocation of External Interrupt Request Levels ...................................................................... 242
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB86602CPF | SCSI BUS CONTROLLER, PQFP100 |
| MB86604LPFV | SCSI BUS CONTROLLER, PQFP100 |
| MB86605PMT | SCSI BUS CONTROLLER, PQFP144 |
| MB86606PMT | SCSI BUS CONTROLLER, PQFP144 |
| MB86612 | 2 CHANNEL(S), 98.304M bps, SERIAL COMM CONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB911110PMT2 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91121 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller |
| MB91121PFV | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller CMOS |
| MB91133 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91133PBT | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
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