參數(shù)資料
型號： MB-91110PMT2
元件分類： 微控制器/微處理器
英文描述： 32-BIT, MROM, 50 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144
文件頁數(shù)： 289/452頁
文件大小： 6219K
代理商： MB-91110PMT2
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13.4 Operations of the DMA Controller
13.4.7 DMA Transfer Start And Pause
DMA transfer start is controlled independently on each channel. However, all channels
should be enabled in the general register.
Pause DMA transfer in the following cases:
Pause setting in the control register
NMI/hold suppression level interrupt processing
s DMA Transfer Start
r Enabling all channels
Before activating each DMAC channel, enable all channels using the DMA enable bit (DMAE).
If the bit is not set, any activation setting or transfer request will be invalid.
r Activating transfer
Set the transfer enable bit in the control register of each channel to activate transfer. When a
transfer request to the activated channel is received, DMA transfer starts in the specified mode.
r Activating from pause status
If transfer is paused on each or all channels before activation, transfer activation does not clear
the pause status and no transfer request is accepted. To accept a transfer request, release the
pause status first.
s Acceptance of Transfer Request and Transfer
The set transfer requirements are sampled from each channel after activation. If a transfer
request is detected, the request is held in the DMAC until the transfer request clear conditions
are satisfied.
A transfer request is always received even when transfer processing is executed on a transfer
request from another channel.
After each unit of transfer, the next processing channel is
determined by checking the priority.
s Pause of DMA Transfer
r Pausing by writing the control register
Set each channel independently or all channels simultaneously.
If the halt bit is set, transfer on the corresponding channel is paused until the setting is cleared.
Transfer starts again when the pause status is cleared.
r NMI/hold suppression level interrupt processing
If an NMI or an interrupt request of a higher level than the hold suppression level is generated,
the DMAC pauses all the current transfer channels at a boundary between units of transfer and
releases the bus privilege to give priority to NMI/interrupt processing.
The DMAC holds a
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PDF描述
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MB86604LPFV SCSI BUS CONTROLLER, PQFP100
MB86605PMT SCSI BUS CONTROLLER, PQFP144
MB86606PMT SCSI BUS CONTROLLER, PQFP144
MB86612 2 CHANNEL(S), 98.304M bps, SERIAL COMM CONTROLLER, PQFP100
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MB911110PMT2 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller
MB91121 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller
MB91121PFV 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller CMOS
MB91133 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller
MB91133PBT 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller
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