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參數(shù)資料
| 型號： | MB-91110PMT2 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 50 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 272/452頁 |
| 文件大?。?/td> | 6219K |
| 代理商： | MB-91110PMT2 |
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319
13.3 Registers of the DMA Controller
This bit can be read and written.
Bit 17: DRLD (Destination Address Register Reload)
This bit controls the reload function for the destination address register of the corresponding
channel.
If the reload function is enabled, the destination address is reset to the initial value after
transfer.
If counter reload is disabled, the transfer is finished after a single shot even when the reload
function is specified to the address register.
The DMAC stops with the initial address
register value reloaded.
If the reload function is disabled, the address register indicates the next address after the
final one at the end of transfer (incremented address if "Address increment" is specified).
0: Disable destination address register reload
1: Enable destination address register reload
Reset does not initialize this bit.
This bit can be read and written.
Bit 16: SRLD (Source Address Register Reload)
This bit controls the reload function for the source address register of the corresponding
channel.
If the reload function is enabled, the source address register value is reset to the initial value
after transfer.
The other detailed functions are the same as bit 17 (DRLD).
0: Disable source address register reload
1: Enable source address register reload
Reset does not initialize this bit.
This bit can be read and written.
Bits 15 to 0: DMAT (Transfer Count Register)
These bits store a transfer count. The register length is 16 bits.
All the registers have dedicated reload registers. If this register is used for a channel where
counter register reload is enabled, the register is automatically returned to the initial value at
the end of transfer.
This does not affect other count registers.
Reset does not initialize these bits.
These bits can be read and written but should always be read by half-word access.
Since the read value by word access is not defined, take great care when using a read-
modify-write instruction.
This register accepts word access for write only.
The read value is always a count and not a reload value.
If the DMAC is activated when the register value is 0, data will be transferred 65536 times.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB86602CPF | SCSI BUS CONTROLLER, PQFP100 |
| MB86604LPFV | SCSI BUS CONTROLLER, PQFP100 |
| MB86605PMT | SCSI BUS CONTROLLER, PQFP144 |
| MB86606PMT | SCSI BUS CONTROLLER, PQFP144 |
| MB86612 | 2 CHANNEL(S), 98.304M bps, SERIAL COMM CONTROLLER, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB911110PMT2 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91121 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller |
| MB91121PFV | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller CMOS |
| MB91133 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91133PBT | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
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