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參數(shù)資料
| 型號(hào)： | MC68000 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | 集成多協(xié)議處理器用戶手冊(cè) |
| 文件頁數(shù)： | 236/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68000 |
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Communications Processor (CP)
4-116
MC68302 USER’S MANUAL
MOTOROLA
4.5.15.1 Bit Rate Adaption of Synchronous Data Signaling Rates up to 19.2 kbps
The V.110 synchronous bit rate adaption block diagram within the terminal adaptor is shown
in Figure 4-38.
Figure 4-38. Two-Step Synchronous Bit Rate Adaption
This function may be implemented with two SCCs, one of which is configured for V.110 op-
eration. Step 1 (RA1) rate adaption can be achieved using one SCC channel programmed
to promiscuous (totally transparent) mode (see 4.5.13 BISYNC Controller). This SCC will
transfer the data between the R interface and IMP memory. The M68000 core must be pro-
grammed to format the data in memory according to the V.110 protocol to create the V.110
80-bit frame. Another SCC is used to transfer the data between IMP memory and the S/T
interface. This SCC should be programmed for V.110 operation, which provides the conver-
sion of the data rate to 64 kbps. Data may be transmitted and received on 1, 2, or 4 bits of
an ISDN B channel as programmed in the SIMASK register.
NOTE
V.110 contains a requirement (under further study) for control in-
formation on the R interface (i.e., RTS, CTS, CD, DTR, and
DSR), conveyed by the S bits in the V.110 frame, not to have a
different transmission delay than the user data conveyed by the
D8–D1 bits. This very time-critical aspect of the standard is not
supported by the IMP. In this case, provision would need to be
made by the user to guarantee correct sampling times for this in-
formation to correspond with the user data. The IMP, however,
can detect changes in these signals and issue appropriate inter-
rupts to the M68000 core, allowing the function to be fully imple-
mented in a slightly longer time period.
4.5.15.2 Rate Adaption of 48- and 56-kbps User Rates to 64 kbps
This function may again be implemented with two SCCs; however, in this case, the SCC
connected to the B channel is programmed to promiscuous (totally transparent) mode rather
than for V.110 operation (see 4.5.9 SCC Transparent Mode). The M68000 core will need to
format the framing pattern in the 48-kbps conversion case. For the 56-kbps rate conversion,
however, the B channel mask (SIMASK) in the serial channel physical interface can be
used.
R
S/T
RA1
RA2
V-SERIES
STEP 1
STEP 2
V
(2**k)*8
kbps
64
kbps
(2**k)*8
kbps
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68302PV16V | Integrated Multiprotocol Processor User’s Manual |
| MC68302PV20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302AD | Integrated Multiprotocol Processor with PCMCIA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68000FN10 | 制造商:Motorola Inc 功能描述:32-BIT, 10 MHz, MICROPROCESSOR, PQCC68 |
| MC68000FN12 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN12F | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN8 | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000G8 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 64 Pin, Plastic, DIP |
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