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參數(shù)資料
| 型號： | MC68000 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | 集成多協(xié)議處理器用戶手冊 |
| 文件頁數(shù)： | 54/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68000 |
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System Integration Block (SIB)
3-4
MC68302 USER’S MANUAL
MOTOROLA
(DAPR), an 8-bit function code register (FCR), a 16-bit byte count register (BCR), a 16-bit
channel mode register (CMR), and an 8-bit channel status register (CSR). These registers
provide the addresses, transfer count, and configuration information necessary to set up a
transfer. They also provide a means of controlling the IDMA and monitoring its status. All
registers can be modified by the M68000 core. The IDMA also includes another 16-bit reg-
ister, the data holding register (DHR), which is not accessible to the M68000 core and is
used by the IDMA for temporary data storage.
3.1.2.1 Channel Mode Register (CMR)
The CMR, a 16-bit register, is reset to $0000.
Bit 15—Reserved for future use.
ECO—External Control Option
0 = If the request generation is programmed to be external in the REQG bits, the con-
trol signals (DACK and DONE) are used in the source (read) portion of the transfer
since the peripheral is the source.
1 = If the request generation is programmed to be external in the REQG bits, the con-
trol signals (DACK and DONE) are used in the destination (write) portion of the
transfer since the peripheral is the destination.
INTN—Interrupt Normal
0 = When the channel has completed an operand transfer without error conditions as
indicated by DONE, the channel does not generate an interrupt request to the IMP
interrupt controller. The DONE bit remains set in the CSR.
1 = When the channel has completed an operand transfer without error conditions as
indicated by DONE, the channel generates an interrupt request to the IMP interrupt
controller and sets DONE in the CSR.
NOTE
An interrupt will only be generated if the IDMA bit is set in the in-
terrupt mask register (IMR).
INTE—Interrupt Error
0 = If a bus error occurs during an operand transfer either on the source read (BES) or
interrupt controller. The appropriate bit remains set in the CSR.
1 = If a bus error occurs during an operand transfer either on BES or BED, the channel
generates an interrupt to the IMP interrupt controller and sets the appropriate bit
(BES or BED) in the CSR.
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0
—
ECO
INTN
INTE
REQG
SAPI
DAPI
SSIZE
DSIZE
BT
RST
STR
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302PV16V | Integrated Multiprotocol Processor User’s Manual |
| MC68302PV20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302AD | Integrated Multiprotocol Processor with PCMCIA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68000FN10 | 制造商:Motorola Inc 功能描述:32-BIT, 10 MHz, MICROPROCESSOR, PQCC68 |
| MC68000FN12 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN12F | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN8 | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000G8 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 64 Pin, Plastic, DIP |
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