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參數(shù)資料
| 型號(hào)： | MC68000 |
| 廠(chǎng)商： | Motorola, Inc. |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | 集成多協(xié)議處理器用戶(hù)手冊(cè) |
| 文件頁(yè)數(shù)： | 256/480頁(yè) |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68000 |
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Communications Processor (CP)
4-136
MC68302 USER’S MANUAL
MOTOROLA
4.6.1 SCP Programming Model
The SCP mode register consists of the upper eight bits of SPMODE. The SCP mode regis-
ter, an internal read-write register that controls both the SCP operation mode and clock
source, is cleared by reset.
STR—Start Transmit
When set, this bit causes the SCP controller to transmit eight bits from the SCP transmit/
receive buffer descriptor (BD) and to receive eight bits of data in this same BD. This bit is
cleared automatically after one system clock cycle.
LOOP—Loop Mode
When set, the loop mode bit selects local loopback operation. The ones complement of
the transmitter output is internally connected to the receiver input; the receiver and trans-
mitter operate normally except that SPRXD is ignored. When cleared, this bit selects nor-
mal operation.
CI—Clock Invert
When set, the CI bit inverts the SCP clock polarity. When CI is zero, transmitted data bits
shift on rising clock edges, and received bits are sampled on falling edges. When the SCP
is idle, the clock is low. While CI is one, transmitted data bits are shifted on falling edges,
and received bits are sampled on rising edges. In this case, when the SCP is idle, the
clock is high.
PM3–PM0—Prescale Modulus Select
The prescale modulus select bits specify the divide ratio of the prescale divider in the SCP
clock generator. The divider value is 4*(“PM3–PM0” + 1) giving a clock divide ratio of 4 to
64 in multiples of 4. With a 16.384-MHz system clock, the maximum SCP clock is 4.096
MHz.
EN—Enable SCP
When set, this bit enables the SCP operation and connects the external pins SPRXD/
CTS3, SPTXD/RTS3, and SPCLK/CD3 internally to the SCP (see Figure 4-45). When
cleared, the SCP is put into a reset state consuming minimal power, and the three pins
are connected back to SCC3.
NOTE
When the DIAG1–DIAG0 bits of SCC3 are programmed to nor-
mal operation control of the CTS and CD lines and the ENT or
ENR bits of SCC3 are set, the user may not modify the EN bit.
15
14
13
12
11
10
9
8
STR
LOOP
CI
PM3
PM2
PM1
PM0
EN
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68302PV16V | Integrated Multiprotocol Processor User’s Manual |
| MC68302PV20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC25 | Integrated Multiprotocol Processor User’s Manual |
| MC68302AD | Integrated Multiprotocol Processor with PCMCIA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68000FN10 | 制造商:Motorola Inc 功能描述:32-BIT, 10 MHz, MICROPROCESSOR, PQCC68 |
| MC68000FN12 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN12F | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000FN8 | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 68 Pin, Plastic, PLCC |
| MC68000G8 | 制造商:Motorola Inc 功能描述:Microprocessor, 32 Bit, 64 Pin, Plastic, DIP |
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