參數(shù)資料
型號： MCIMX537CVV8C
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 800 MHz, RISC PROCESSOR, PBGA529
封裝： 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, TEPBGA-529
文件頁數(shù)： 123/172頁
文件大小： 4562K
代理商： MCIMX537CVV8C
i.MX53 Applications Processors for Industrial Products, Rev. 3
54
Freescale Semiconductor
Electrical Characteristics
WE3
BCLK High Level
Width
0.4*t
0.8*t
1.2*t
1.6*t
WE4
Clock rise to
address valid3
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE5
Clock rise to
address invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE6
Clock rise to
CSx_B valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE7
Clock rise to
CSx_B invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE8
Clock rise to
WE_B Valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE9
Clock rise to
WE_B Invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE10 Clock rise to OE_B
Valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE11 Clock rise to OE_B
Invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE12 Clock rise to
BEy_B Valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE13 Clock rise to
BEy_B Invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE14 Clock rise to
ADV_B Valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE15 Clock rise to
ADV_B Invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE16 Clock rise to
Output Data Valid
-0.5*t-1.25
-0.5*t+1.75
-t-1.25
-t+1.75
-1.5*t-1.2
5
-1.5*t
+1.75
-2*t-1.25
-2*t+1.75
WE17 Clock rise to
Output Data
Invalid
0.5*t-1.25
0.5*t+1.75
t-1.25
t+1.75
1.5*t-1.2
5
1.5*t +1.75
2*t-1.25
2*t+1.75
WE18 Input Data setup
time to Clock rise
2
—
4
—
———
WE19 Input Data hold
time from Clock
rise
2
—
2
—
———
WE20 WAIT_B setup
time to Clock rise
2
—
4
—
———
WE21 WAIT_B hold time
from Clock rise
2
—
2
—
———
Table 38. EIM Bus Timing Parameters (continued)1
ID
Parameter
BCD = 0
BCD = 1
BCD = 2
BCD = 3
Min
Max
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料
PDF描述
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