參數(shù)資料
型號(hào)： MCIMX537CVV8C
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 800 MHz, RISC PROCESSOR, PBGA529
封裝： 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, TEPBGA-529
文件頁(yè)數(shù)： 136/172頁(yè)
文件大?。?/td> 4562K
代理商： MCIMX537CVV8C
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i.MX53 Applications Processors for Industrial Products, Rev. 3
66
Freescale Semiconductor
Electrical Characteristics
Figure 31. DDR SDRAM DQ vs. DQS and SDCLK Read Cycle
4.7
External Peripheral Interfaces Parameters
The following subsections provide information on external peripheral interfaces.
4.7.1
AUDMUX Timing Parameters
The AUDMUX provides a programmable interconnect logic for voice, audio and data routing between
internal serial interfaces (SSIs) and external serial interfaces (audio and voice codecs). The AC timing of
AUDMUX external pins is governed by the SSI module. For more information, see the respective SSI
electrical specifications found within this document.
4.7.2
CSPI and ECSPI Timing Parameters
This section describes the timing parameters of the CSPI and ECSPI blocks. The CSPI and ECSPI have
separate timing parameters for master and slave modes. The nomenclature used with the CSPI / ECSPI
modules and the respective routing of these signals is shown in Table 44.
Table 43. DDR SDRAM Read Cycle 1
1 To receive the reported setup and hold values, read calibration should be performed in order to locate the DQS in the middle
of DQ window.
ID
Parameter
Symbol
SDCLK = 400 MHz
Unit
Min
Max
DDR26
Minimum required DQ valid window width
except from LPDDR2
—0.6
—
ns
DDR26(LP
DDR2)
Minimum required DQ valid window width
for LPDDR2
—0.425
—
ns
DDR27
DQS to DQ valid data
—
0.275
0.475
ns
SDCLK
SDCLK_B
DQS (input)
DQ (input)
DATA
DDR26
DDR27
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MCIMX538DZK1C 功能描述:處理器 - 專門(mén)應(yīng)用 I.MX53 2.1 POP RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:1 GHz 指令/數(shù)據(jù)緩存: 數(shù)據(jù) RAM 大小:128 KB 數(shù)據(jù) ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:MAPBGA-432
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