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參數(shù)資料
| 型號(hào)： | MPC5200 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Hardware Specifications |
| 中文描述： | 硬件規(guī)格 |
| 文件頁(yè)數(shù)： | 75/80頁(yè) |
| 文件大?。?/td> | 790K |
| 代理商： | MPC5200 |
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System Design Information
MPC5200 Data Sheet, Rev. 4
Freescale Semiconductor
75
Figure 54. PORRESET vs. JTAG_TRST
5.4.1.2
The wiring of the JTAG_TRST depends on the existence of a board-related debug interface (see
Table 53
below).
Connecting JTAG_TRST
Normally this interface is implemented, using a COP (common on-chip processor) connector. The COP
allows a remote computer system (typically, a PC with dedicated hardware and debugging software) to
access and control the internal operations of the MPC5200.
5.4.2
G2_LE COP/BDM Interface
There are two possibilities to connect the JTAG interface: using it with a COP connector and without a
COP connector.
5.4.2.1
The MPC5200 functional pin interface and internal logic provides access to the embedded G2_LE
processor core through the Freescale (formerly Motorola) standard COP/BDM interface.
Table 53
gives
the COP/BDM interface signals. The pin order shown reflects only the COP/BDM connector order.
Boards interfacing the JTAG port via a COP connector
Table 53. COP/BDM Interface Signals
BDM
Pin #
MPC5200
I/O Pin
BDM
Connector
Internal
PullUp/Down
External
PullUp/Down
I/O
1
16
—
GND
—
—
—
15
TEST_SEL_0
ckstp_out
—
—
I
14
—
KEY
—
—
—
13
HRESET
hreset
10k Pull-Up
O
12
—
GND
—
—
—
11
SRESET
sreset
10k Pull-Up
O
10
—
N/C
—
—
—
9
JTAG_TMS
tms
100k Pull-Up
10k Pull-Up
O
JTAG_TRST
PORRESET
required assertion of JTAG_TRST
optional assertion of JTAG_TRST
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