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參數(shù)資料
| 型號： | MSC8101VT1375F |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 94/104頁 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT 250MHZ 332-FCPBGA |
| 標準包裝： | 90 |
| 系列： | StarCore |
| 類型： | SC140 內核 |
| 接口： | 通信處理器模塊（CPM） |
| 時鐘速率： | 275MHz |
| 非易失內存： | 外部 |
| 芯片上RAM： | 512kB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.60V |
| 工作溫度： | -40°C ~ 105°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 332-BFBGA，F(xiàn)CPBGA |
| 供應商設備封裝： | 332-FCBGA（17x17） |
| 包裝： | 托盤 |
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Reset, Configuration, and EOnCE Event Signals
MSC8101 Technical Data, Rev. 19
Freescale Semiconductor
1-5
1.3 Reset, Configuration, and EOnCE Event Signals
CLKOUT
Output
Clock Out
The system bus clock.
DLLIN
Input
DLLIN
Synchronizes with an external device.
Note:
When the DLL is disabled, connect this signal to GND.
Table 1-4.
Reset, Configuration, and EOnCE Event Signals
Signal Name
Type
Signal Description
DBREQ
EE01
Input
Output
Debug Request
Determines whether to go into SC140 Debug mode when PORESET is deasserted.
Enhanced OnCE (EOnCE) Event 0
After PORESET is deasserted, you can configure EE0 as an input (default) or an output.
Debug request, enable Address Event Detection Channel 0, or generate an EOnCE event.
Detection by Address Event Detection Channel 0. Used to trigger external debugging equipment.
HPE
EE11
Input
Output
Host Port Enable
When this pin is asserted during PORESET, the Host port is enabled, the system data bus is 32 bits
wide, and the Host must program the reset configuration word.
EOnCE Event 1
After PORESET is deasserted, you can configure EE1 as an input (default) or an output.
Enable Address Event Detection Channel 1 or generate an EOnCE event.
Debug Acknowledge or detection by Address Event Detection Channel 1. Used to trigger external
debugging equipment.
EE21
Input
Output
EOnCE Event 2
After PORESET is deasserted, you can configure EE2 as an input (default) or an output.
Enable Address Event Detection Channel 2 or generate an EOnCE event or enable the Event
Counter.
Detection by Address Event Detection Channel 2. Used to trigger external debugging equipment.
EE31
Input
Output
EOnCE Event 3
After PORESET is deasserted, you can configure EE3 as an input (default) or an output. See the
emulation and debug chapter in the SC140 DSP Core Reference Manual for details on the ERCV
Register.
Enable Address Event Detection Channel 3 or generate one of the EOnCE events.
The DSP has read the EOnCE Receive Register (ERCV). Triggers external debugging equipment.
Table 1-3.
Clock Signals (Continued)
Signal Name
Type
Signal Description
相關PDF資料 |
PDF描述 |
|---|---|
| EBC10DRXS | CONN EDGECARD 20POS DIP .100 SLD |
| TACA107M004RTA | CAP TANT 100UF 4V 20% 1206 |
| HCC07DRXI | CONN EDGECARD 14POS DIP .100 SLD |
| FMC13DRAH | CONN EDGECARD 26POS R/A .100 SLD |
| EMM44DRXS | CONN EDGECARD 88POS DIP .156 SLD |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MSC8101VT1500F | 功能描述:IC DSP 16BIT 250MHZ 332-FCPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數(shù)字式信號處理器） 系列:StarCore 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網(wǎng)，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，F(xiàn)CBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
| MSC8102 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Quad Core 16-Bit Digital Signal Processor |
| MSC81020 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:RF & MICROWAVE TRANSISTORS GENERAL PURPOSE AMPLIFIER APPLICATIONS |
| MSC8102M4000 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Quad Core 16-Bit Digital Signal Processor |
| MSC8102M4400 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Quad Core 16-Bit Digital Signal Processor |
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