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參數(shù)資料
| 型號(hào)： | MT9076 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | T1/E1/J1 3.3V Single Chip Transceiver |
| 中文描述： | T1/E1/J1收發(fā)3.3V的單芯片收發(fā)器 |
| 文件頁(yè)數(shù)： | 140/160頁(yè) |
| 文件大小： | 416K |
| 代理商： | MT9076 |
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MT9076
Preliminary Information
136
Bit
Name
Functional Description
7
- --
Unused.
6-4
RFFS2-0
These bits select the RXFF (Rx FIFO Full) interrupt threshold level:
RFFS2
RFFS1
RFFS0
RX FIFO Full Interrupt threshold Level.
0
0
0
64
0
0
1
72
0
1
0
80
0
1
1
88
1
0
0
96
1
0
1
104
1
1
0
112
1
1
1
120
3
- --
Unused.
2-0
TFLS2-0
These bits select the TXFL (Tx FIFO Low) interrupt threshold level:
TFLS2
TFLS1
TFLS0
TX FIFO Low Interrupt threshold Level.
0
0
0
8
0
0
1
16
0
1
0
24
0
1
1
32
1
0
0
40
1
0
1
48
1
1
0
56
1
1
1
64
Table 172 - HDLC Control Register 4
(Page B, C & D, Address 1EH)
Bit
Name
Functional Description
7-0
TxCNT15-8
Extended Transmit Byte Count Register.
This register, along with the Transmit Byte
Count Register indicates the length of the packet about to be transmitted. Values
programmed into this register are not internally updated until the next write to the Low
Transmit Byte Count Register. When the internal counter decrements to one, the next
write to the Tx FIFO will be tagged as an end of packet byte. The counter decrements at
the end of the write to the Tx FIFO. If the Cycle bit of Control Register 2 is set high, the
counter will cycle through the programmed value continuously.
Table 173 - Extended Transmit Byte Count Register
(Page B,C & D, Address 1FH)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT9076AB | T1/E1/J1 3.3V Single Chip Transceiver |
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參數(shù)描述 |
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| MT9076AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:T1/E1/J1 3.3V Single Chip Transceiver |
| MT9076B | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:T1/E1/J1 3.3 V Single Chip Transceiver |
| MT9076BB | 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 80LQFP - Trays |
| MT9076BB1 | 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 80LQFP - Trays |
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