- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383645 > MT9076 (Mitel Networks Corporation) T1/E1/J1 3.3V Single Chip Transceiver(T1/E1/J1 3.3V 單片收發(fā)器) PDF資料下載
參數(shù)資料
| 型號(hào)： | MT9076 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | T1/E1/J1 3.3V Single Chip Transceiver(T1/E1/J1 3.3V 單片收發(fā)器) |
| 中文描述： | T1/E1/J1收發(fā)3.3V的單芯片收發(fā)器（T1/E1/J1收發(fā)3.3單片收發(fā)器） |
| 文件頁數(shù)： | 105/162頁 |
| 文件大?。?/td> | 427K |
| 代理商： | MT9076 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁當(dāng)前第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁
Preliminary Information
MT9076
101
Bit
Name
Functional Description
7
FEOM
Frame Alignment Signal Error Counter Overflow Interrupt Mask
. When unmasked an
interrupt is initiated when the frame alignment signal error counter overflows. If 1 -
unmasked, 0 - masked.
6
CRCOIM
CRC-4 Error Counter Overflow Interrupt Mask
. When unmasked an interrupt is initiated
when the CRC-4 error counter overflows. If 1 - unmasked, 0 - masked.
5
- - -
Unused.
4
EBOIM
Receive E-bit Counter Overflow Interrupt Mask
. When unmasked an interrupt is
initiated when the E-bit error counter overflows. If 1 - unmasked, 0 - masked.
3
LCVCOM
Line Code Violation Counter Overflow Interrupt Mask.
When unmasked (LCVO = 1),
an interrupt is initiated when the line code violation error counter changes form FFFFH to
0H. If 1- unmasked 0 - masked.
2
PRBSOM
PRBS Counter Overflow Interrupt Mask
. When unmasked (PRBSO = 1), an interrupt is
initiated on overflow of PRBS counter (page 04H, address 10H) from FFH to 0H. If 1-
unmasked 0 - masked.
1
PRBSMFOM
PRBS MultiFrame Counter Overflow Interrupt Mask.
When unmasked an interrupt will
be generated whenever the multiframe counter attached to the PRBS error counter
overflows. If 1- unmasked 0 - masked.
0
SaIM
Sa Bits Interrupt Masks
. When unmasked an interrupt will be triggered by either a
change of state of any of the received Sa bits Sa5, Sa6, Sa7 or Sa8 (SaBorNi = 1) or a
change of state of any of the received Sa nibbles (SaBorNi = 0). The control bit SaBorNi is
located in page 1 address 12H bit 4. If 1- unmasked 0 - masked.
Table 100 - Interrupt Mask Word Two (E1)
(Page 1, Address 1DH)
相關(guān)PDF資料 |
PDF描述 |
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| MT9076BB | 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 80LQFP - Trays |
| MT9076BB1 | 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 80LQFP - Trays |
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