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參數(shù)資料
| 型號(hào)： | P60ARM-B |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | Low power, general purpose 32-bit RISC microprocessor |
| 中文描述： | 低功耗，通用32位RISC微處理器 |
| 文件頁(yè)數(shù)： | 44/120頁(yè) |
| 文件大?。?/td> | 1275K |
| 代理商： | P60ARM-B |
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P60ARM-B
40
[Rn,{+/-}Rm{,<shift>}]{!}
offset of +/- contents of index register, shifted by <shift>
(iii)
A post-indexed addressing specification:
[Rn],<#expression>
offset of <expression> bytes
[Rn],{+/-}Rm{,<shift>}
offset of +/- contents of index register, shifted as by <shift>.
Rn and Rm are expressions evaluating to a register number. If Rn is R15 then the assembler will subtract 8
from the offset value to allow for ARM60 pipelining. In this case base write-back shall not be specified.
<shift> is a general shift operation (see section on data processing instructions) but note that the shift
amount may not be specified by a register.
{!} writes back the base register (set the W bit) if ! is present.
4.7.9 Examples
STR
R1,[R2,R4]!
; store R1 at R2+R4 (both of which are
; registers) and write back address to R2
STR
R1,[R2],R4
; store R1 at R2 and write back
; R2+R4 to R2
LDR
R1,[R2,#16]
; load R1 from contents of R2+16
; Don't write back
LDR
R1,[R2,R3,LSL#2]
; load R1 from contents of R2+R3*4
LDREQB
R1,[R6,#5]
; conditionally load byte at R6+5 into
; R1 bits 0 to 7, filling bits 8 to 31
; with zeros
STR
R1,PLACE
; generate PC relative offset to address
; PLACE
PLACE
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