參數(shù)資料
型號(hào)： PCI4410A
廠(chǎng)商： Texas Instruments, Inc.
英文描述： PC CARD AND OHCI CONTROLLER
中文描述： PC卡和OHCI控制器
文件頁(yè)數(shù)： 11/198頁(yè)
文件大小： 892K
代理商： PCI4410A
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DMA Multichannel/Mask Register Description
Bit-Field Access Tag Descriptions
PCI Configuration Register Map
PCI Command Register Description
PCI Status Register Description
Class Code and Revision ID Register Description
Latency Timer and Class Cache Line Size Register Description
Header Type and BIST Register Description
Open HCI Registers Base Address Register Description
TI Extension Base Address Register Description
PCI Subsystem Identification Register Description
Interrupt Line and Interrupt Pin Registers Description
MIN_GNT and MAX_LAT Registers Description
Capability ID and Next Item Pointer Registers Description
Power Management Capabilities Register Description
Power Management Control and Status Register Description
Power Management Extension Register Description
PCI Miscellaneous Configuration Register Description
Link Enhancement Control Register Description
Subsystem Access Identification Register Description
GPIO Control Register Description
Open HCI Register Map
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OHCI Version Register Description
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GUID ROM Register Description
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Asynchronous Transmit Retries Register Description
CSR Control Register Description
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Configuration ROM Header Register Description
Bus Options Register Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Configuration ROM Mapping Register Description
Posted Write Address Low Register Description
Posted Write Address High Register Description
Host Controller Control Register Description
Self ID Count Register Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Isochronous Receive Channel Mask High Register Description
Isochronous Receive Channel Mask Low Register Description
Interrupt Event Register Description
Interrupt Mask Register Description
Isochronous Transmit Interrupt Event Register Description
Isochronous Receive Interrupt Event Register Description
Fairness Control Register Description
Link Control Register Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Node Identification Register Description
PHY Control Register Description
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Isochronous Cycle Timer Register Description
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