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參數(shù)資料
| 型號： | PM7383-PI |
| 廠商： | PMC-Sierra, Inc. |
| 英文描述： | FRAME ENGINE AND DATA LINK MANAGER 32A256 |
| 中文描述： | 框架引擎和數(shù)據(jù)鏈路管理32A256 |
| 文件頁數(shù)： | 6/231頁 |
| 文件大?。?/td> | 1947K |
| 代理商： | PM7383-PI |
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RELEASED
DATASHEET
PM7383 FREEDM-32A256
ISSUE 1
PMC-2010336
FRAME ENGINE AND DATA LINK MANAGER 32A256
PROPRIETARY AND CONFIDENTIAL
v
FIGURE 23 – RECEIVE APPI TIMING (AUTO DESELECTION) ....................195
FIGURE 24 – RECEIVE APPI TIMING (OPTIMAL RESELECTION)...............196
FIGURE 25 – RECEIVE APPI TIMING (BOUNDARY CONDITION) ...............196
FIGURE 26 – TRANSMIT APPI TIMING (NORMAL TRANSFER)...................197
FIGURE 27 – TRANSMIT APPI TIMING (SPECIAL CONDITIONS)................198
FIGURE 28 – TRANSMIT APPI TIMING (POLLING).......................................199
FIGURE 29 – RECEIVE BERT PORT TIMING................................................200
FIGURE 30 – TRANSMIT BERT PORT TIMING .............................................201
FIGURE 31 – RECEIVE DATA & FRAME PULSE TIMING (2.048 MBPS H-MVIP
MODE)..................................................................................................208
FIGURE 32 – RECEIVE DATA & FRAME PULSE TIMING (8.192 MBPS H-MVIP
MODE)..................................................................................................208
FIGURE 33 – RECEIVE DATA TIMING (NON H-MVIP MODE).......................209
FIGURE 34 – BERT INPUT TIMING ...............................................................209
FIGURE 35 – TRANSMIT DATA & FRAME PULSE TIMING (2.048 MBPS H-
MVIP MODE) ........................................................................................211
FIGURE 36 – TRANSMIT DATA & FRAME PULSE TIMING (8.192 MBPS H-
MVIP MODE) ........................................................................................212
FIGURE 37 – TRANSMIT DATA TIMING (NON H-MVIP MODE)....................212
FIGURE 38 – BERT OUTPUT TIMING ...........................................................213
FIGURE 39 – RECEIVE ANY-PHY PACKET INTERFACE TIMING.................214
FIGURE 40 – TRANSMIT ANY-PHY PACKET INTERFACE TIMING..............215
FIGURE 41 – MICROPROCESSOR READ ACCESS TIMING .......................216
FIGURE 42 – MICROPROCESSOR WRITE ACCESS TIMING......................218
FIGURE 43 – JTAG PORT INTERFACE TIMING............................................219
FIGURE 44 – 329 PIN PLASTIC BALL GRID ARRAY (PBGA)........................221
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7384 | Frame Engine and Data Link Manager |
| PM7384-BI | FRAME ENGINE AND DATA LINK MANAGER 84P672 |
| PM7385 | Frame Engine and Data Link Manager |
| PM7385-BI | 84 LINK, 672 CHANNEL FRAME ENGINE AND DATA LINK MANAGER WITH ANY-PHY PACKET INTERFACE |
| PM7388 | Frame Engine and Datalink Manager |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7384 | 制造商:PMC 制造商全稱:PMC 功能描述:Frame Engine and Data Link Manager |
| PM7384-BI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER 84P672 |
| PM7385 | 制造商:PMC 制造商全稱:PMC 功能描述:Frame Engine and Data Link Manager |
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