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參數(shù)資料
| 型號： | PSB7110 |
| 廠商： | SIEMENS AG |
| 英文描述： | Enhanced ISDN Data Access Controller ISAR |
| 中文描述： | 增強(qiáng)綜合業(yè)務(wù)數(shù)字網(wǎng)的數(shù)據(jù)接入控制器專家組 |
| 文件頁數(shù)： | 149/164頁 |
| 文件大?。?/td> | 1173K |
| 代理商： | PSB7110 |
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_________________________________________________PSB 7110
Siemens Aktiengesellschaft
Page 149
5.
Example Configuration Settings
To give a better understanding how to program each of the parameters, some examples are given
below for each of the functional blocks.
The mechanism to transfer messages from the host to the ISAR is described in chapter 3.1.2. It
should be noted, that the host interrupt status register (HIS) must only be written as the last register
access for the message.
Buffer Configuration
Set channel 1 to buffer base priority 5 and maximum message length of 32:
Control Reg. MSB
Control Reg. LSB
1. Parameter
HIS
=
=
=
=
05h
01h
20h
64h
Set channel 2 to buffer base priority 3 without changing the maximum message length:
Control Reg. MSB
Control Reg. LSB
No parameters
HIS
=
=
03h
0
=
A4h
Set channel 2 to maximum message length 32 without changing the buffer base priority:
Control Reg. MSB
Control Reg. LSB
1. Parameter
HIS
=
=
=
=
0
1
20h
A4h
SART Configuration
Set channel 1 to HDLC mode with regular I/O, "1" as interframe fill16 bit FCS length. In case of data
underrun, FCS and final flag should be generated automatically (TX direction):
Control Reg. MSB
Control Reg. LSB
1. Parameter
HIS
=
=
=
=
03h
01h
09h
65h
Set channel 2 to V.14 mode (synchronous modulation) with 25% overspeed range, even parity, two
stop bits, 6 bit character size and a buffer flush timeout of 32:
Control Reg. MSB
Control Reg. LSB
1. Parameter
2. Parameter
HIS
=
=
=
=
=
02h
02h
5Dh
20h
A5h
相關(guān)PDF資料 |
PDF描述 |
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