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參數(shù)資料
| 型號： | TFRA08C13 |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 164/188頁 |
| 文件大?。?/td> | 3047K |
| 代理商： | TFRA08C13 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁當(dāng)前第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁
Preliminary Data Sheet
October 2000
TFRA08C13 OCTAL T1/E1 Framer
164
L Lucent Technologies Inc.
Framer Register Architecture
(continued)
CHI Transmit Control Register (FRM_PR65)
The default value of this register is 00 (hex).
Table 158. CHI Transmit Control Register (FRM_PR65) (YA1)
CHI Receive Control Register (FRM_PR66)
The default value of this register is 00 (hex).
Table 159. CHI Receive Control Register (FRM_PR66) (YA2)
Bit
0
Symbol
TBYOFF6
Description
Transmit CHI 64-Byte Offset.
A 1 enables a 64-byte offset from CHIFS to the beginning
of the next transmit CHI frame on TCHIDATA. A 0 enables a 0-byte offset (if bit 0—bit 5
of FRM_PR47 = 0). Combing bit 0—bit 5 of FRM_PR47 with this bit allows programming
the byte offset from 0—127.
Transmit CHI Double Time-Slot Mode.
A 1 enables the transmit CHI double time-slot
mode. In this mode, the CHI clock runs at twice the rate of TCHIDATA.
Reserved.
Write to 0.
1
TCHIDTS
2—7
—
Bit
0
Symbol
RBYOFF6
Description
Receive CHI 64-Byte Offset.
A 1 enables a 64-byte offset from CHIFS to the beginning of
the next receive CHI frame on RCHIDATA. A 0 enables a 0-byte offset (if bit 0—
bit 5 of FRM_PR48 = 0). Combing bit 0—bit 5 of FRM_PR48 with this bit allows program-
ming the byte offset from 0—127.
Receive CHI Double Time-Slot Mode.
A 1 enables the transmit CHI double time-slot
mode. In this mode, the CHI clock runs at twice the rate of RCHIDATA.
Reserved.
Write to 0.
1
RCHIDTS
2—7
—
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TFRA08C13 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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