參數(shù)資料
型號(hào)： TMX320TCI6482
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Communications Infrastructure Digital Signal Processor
中文描述： 通信基礎(chǔ)設(shè)施的數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 131/255頁(yè)
文件大?。?/td> 1893K
代理商： TMX320TCI6482
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CLKIN1
PCLK
RESET
RESETSTAT
SYSREFCLK (PLL1C)
Z Group
POR
SYSCLK3
SYSCLK4
SYSCLK5
AECLKOUT (Internal)
CBoot and Device
Low Group
High Group
CLKIN2
Internal Reset PLL2C
SYSREFCLK (PLL2C)
SYSCLK1 (PLL2C)
SYSCLK2
5
9
7
8
Undefined
Undefined
Low
High-Z
Undefined
High
PLL2 Unlocked
PLL2 Locked
(A)
PLL2 Unlocked
Clock Valid
Undefined
Undefined
Undefined
Clock Valid
(B)
Power Supplies Ramping
Power Supplies Stable
TMS320TCI6482
Communications Infrastructure Digital Signal Processor
SPRS246F–APRIL 2005–REVISED MAY 2007
A.
B.
C.
D.
E.
SYSREFCLK of the PLL2 controller runs at CLKIN2 ×10.
SYSCLK1 of PLL2 controller runs at SYSREFCLK/2 (default).
Power supplies, CLKIN1, CLKIN2 (if used), and PCLK (if used) must be stable before the start of t
w(POR)
.
Do not tie the RESET and POR pins together.
The RESET pin can be brought high after the POR pin has been brought high. In this case, the RESET pin must be
held low for a minimum of t
w(RESET)
after the POR pin has been brought high.
Figure 8-8. Power-Up Timing
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C64x+ Peripheral Information and Electrical Specifications
131
相關(guān)PDF資料
PDF描述
TMX320TCI6482ZTZ Communications Infrastructure Digital Signal Processor
TMX320TCI6482ZTZ8 Communications Infrastructure Digital Signal Processor
TMX320TCI6482ZTZA Communications Infrastructure Digital Signal Processor
TMX320TCI6482ZTZA8 Communications Infrastructure Digital Signal Processor
TMX380SRAFNL Communications Interface
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TMX320VC5402GGLL100 制造商:Rochester Electronics LLC 功能描述:- Bulk
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