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參數(shù)資料
| 型號： | ZL50018GAC |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 路由/交換 |
| 英文描述： | 2 K Digital Switch with Enhanced Stratum 3 DPLL |
| 中文描述： | TELECOM, DIGITAL TIME SWITCH, PBGA256 |
| 封裝： | 17 X 17 MM, 1.61 MM HEIGHT, PLASTIC, MS-034, BGA-256 |
| 文件頁數(shù)： | 93/136頁 |
| 文件大?。?/td> | 1448K |
| 代理商： | ZL50018GAC |
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ZL50018
Data Sheet
93
Zarlink Semiconductor Inc.
Bit
Name
Description
15 - 3
Unused
Reserved.
In normal functional mode, these bits
MUST
be set to zero.
2 - 0
OJP2 - 0
Output Jitter Performance Bits:
These bits are used to control the DPLL output jitter
performance with respect to the noise received through the output pins. The higher
value (unsigned) means more filtering, while zero means filter bypass. The default
value of 2
H
gives the best performance for most circumstances.
Table 60 - Output Jitter Control Register (OJCR) Bits
Bit
Name
Description
15 - 9
Unused
Reserved
.
In normal functional mode, these bits
MUST
be set to zero
.
8 - 6
STIN[n]BD2 - 0
Input Stream[n] Bit Delay Bits.
The binary value of these bits refers to the number of bits that the input stream
will be delayed relative to FPi. The maximum value is 7. Zero means no delay.
5 - 4
STIN[n]SMP1 - 0
Input Data Sampling Point Selection Bits
:
Table 61 - Stream Input Control Register 0 - 31 (SICR0 - 31) BIts
External Read/Write Address: 006C
H
Reset Value: 0002
H
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
0
0
0
0
0
0
OJP2
OJP1
OJP0
External Read/Write Address: 0100
H
- 011F
H
Reset Value: 0000
H
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
STIN[n]
BD2
STIN[n]
BD1
STIN[n]
BD0
STIN[n]
SMP1
STIN[n]
SMP0
STIN[n]
DR3
STIN[n]
DR2
STIN[n]
DR1
STIN[n]
DR0
STIN[n]SMP1-0
Sampling Point
(2.048 Mbps, 4.096 Mbps, 8.192 Mbps streams)
Sampling Point
(16.384 Mbps streams)
00
3/4 point
2/4 point
01
1/4 point
10
2/4 point
4/4 point
11
4/4 point
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ZL50018QCC | 2 K Digital Switch with Enhanced Stratum 3 DPLL |
| ZL50019 | Enhanced 2 K Digital Switch with Stratum 4E DPLL |
| ZL50019GAC | Enhanced 2 K Digital Switch with Stratum 4E DPLL |
| ZL50019QCC | Enhanced 2 K Digital Switch with Stratum 4E DPLL |
| ZL50022 | Enhanced 4 K Digital Switch with Stratum 4E DPLL |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ZL50018GAG2 | 制造商:Microsemi Corporation 功能描述:SWIT FABRIC 2K X 2K 1.8V/3.3V 256BGA - Trays 制造商:MICROSEMI CONSUMER MEDICAL PRODUCT GROUP 功能描述:IC TDM SWITCH 2K-CH ENH 256PBGA 制造商:Microsemi Corporation 功能描述:IC TDM SWITCH 2K-CH ENH 256PBGA |
| ZL50018QCC | 制造商:Microsemi Corporation 功能描述:SWIT FABRIC 2K X 2K 1.8V/3.3V 256LQFP - Trays |
| ZL50018QCG1 | 制造商:Microsemi Corporation 功能描述:PB FREE 2K+ RATE CONVERSION AND S3 DPLL - Trays 制造商:MICROSEMI CONSUMER MEDICAL PRODUCT GROUP 功能描述:IC TDM SWITCH 2K-CH ENH 256LQFP |
| ZL50019 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Enhanced 2 K Digital Switch with Stratum 4E DPLL |
| ZL50019_06 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Enhanced 2 K Digital Switch with Stratum 4E DPLL |
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