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參數(shù)資料
型號(hào)： AD14060LBF-4
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 17/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP CMOS 32BIT 308CQFP
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： 主機(jī)接口，連接端口，串行端口
時(shí)鐘速率： 40MHz
非易失內(nèi)存： 外部
芯片上RAM： 2MB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 3.30V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 308-CBQFP
供應(yīng)商設(shè)備封裝： 308-CQFP（52x52）
包裝： 托盤(pán)
AD14060/AD14060L
Rev. B | Page 24 of 48
5 V
3.3 V
Parameter
Min
Max
Min
Max
Unit
External Late Frame Sync
Switching Characteristics:
tDDTLFSE
Data Delay from Late External TFS or External RFS
with MCE = 1, MFD = 04
14.1
14.3
ns
tDDTENFS
Data Enable from Late FS or MCE = 1, MFD = 04
3.0
3.5
ns
To determine whether communication is possible between two devices at clock speed n, the following specifications must be confirmed: 1) frame sync delay and frame
sync setup and hold, 2) data delay and data setup and hold, and 3) SCLK width.
1 Referenced to sample edge.
2 RFS hold after RCK when MCE = 1, MFD = 0 is 0.5 ns minimum from drive edge. TFS hold after TCK for late external TFS is 0.5 ns minimum from drive edge.
3 Referenced to drive edge.
4 MCE = 1, TFS enable and TFS valid follow tDDTLFSE and tDDTENFS.
DRIVE
SAMPLE
DRIVE
TCLK
TFS
DT
DRIVE
SAMPLE
DRIVE
FIRST BIT
SECOND BIT
DT
RCLK
RFS
FIRST BIT
SECOND BIT
LATE EXTERNAL TFS
EXTERNAL RFS WITH MCE = 1, MFD = 0
tSFSE/I
tHFSE/I1
tDDTLFSE
tDDTENFS
tHDTE/I
tDDTE/I
tSFSE/I
tDDTE/I
tHDTE/I
tDDTENFS
tDDTLFSE
00667-026
1RFS HOLD AFTER RCK WHEN MCE = 1, MFD = 0 IS 0.5ns MINIMUM FROM DRIVE EDGE.
TFS HOLD AFTER TCK FOR LATE EXTERNAL TFS IS 0.5ns MINIMUM FROM DRIVE EDGE.
Figure 17. External Late Frame Sync
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PDF描述
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參數(shù)描述
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