參數(shù)資料
型號： ADSP-BF504BCPZ-4F
廠商： Analog Devices Inc
文件頁數(shù)： 19/80頁
文件大?。?/td> 0K
描述： IC CCD SIGNAL PROCESSOR 88LFCSP
視頻文件： Blackfin? BF50x Processor Family
標準包裝： 1
系列： Blackfin®
類型： 定點
接口： CAN，EBI/EMI，I²C，IrDA，PPI，SPI，SPORT，UART/USART
時鐘速率： 400MHz
非易失內(nèi)存： 閃存（16MB）
芯片上RAM： 68kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.29V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 88-VFQFN 裸露焊盤，CSP
供應商設(shè)備封裝： 88-LFCSP（12x12）
包裝： 托盤
Rev. A
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July 2011
ADSP-BF504/ADSP-BF504F/ADSP-BF506F
ADSP-BF50x Clock Related Operating Conditions
Table 14 describes the core clock timing requirements for the
ADSP-BF50x processors. Take care in selecting MSEL, SSEL,
and CSEL ratios so as not to exceed the maximum core clock
and system clock (see Table 16). Table 15 describes phase-
locked loop operating conditions.
Table 14. Core Clock (CCLK) Requirements—ADSP-BF50x Processors—All Speed Grades
Parameter
Min VDDINT
Nom VDDINT
Max CCLK
Frequency
Unit
fCCLK
Core Clock Frequency (All Models)
1.33 V
1.400 V
400
MHz
Core Clock Frequency (Industrial/Commercial Models)
1.16 V
1.225 V
300
MHz
Core Clock Frequency (Industrial Models Only)
1.14 V
1.200 V
200
MHz
Core Clock Frequency (Commercial Models Only)
1.10 V
1.150 V
200
MHz
Table 15. Phase-Locked Loop Operating Conditions
Parameter
Min
Max
Unit
fVCO
Voltage Controlled Oscillator (VCO) Frequency
(Commercial/Industrial Models)
72
Instruction Rate
1
MHz
Voltage Controlled Oscillator (VCO) Frequency
(Automotive Models)
84
Instruction Rate
MHz
Table 16. Maximum SCLK Conditions for ADSP-BF50x Processors
Parameter
VDDEXT = 1.8 V/2.5 V/3.3 V Nominal
Unit
f
SCLK
CLKOUT/SCLK Frequency (V
DDINT
≥ 1.16 V)
100
MHz
CLKOUT/SCLK Frequency (V
DDINT
< 1.16 V)
80
MHz
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PDF描述
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參數(shù)描述
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