AMD
P R E L I M I N A R Y
10
Am79C930
TIR10: TX FIFO Data Register
TIR11: Transmit Sequence Control
TIR12: Byte Count Register LSB
TIR13: Byte Count Register MSB
TIR14: Byte Count Limit LSB
TIR15: Byte Count Limit MSB
TIR16: Receiver Control
TIR17: Receive Status Register
TIR18: RX FIFO Data Register
TIR19: Reserved
TIR20: CRC32 Correct Byte Count LSB
TIR21: CRC32 Correct Byte Count MSB
TIR22: CRC8 Correct Byte Count LSB
TIR23: CRC8 Correct Byte Count MSB
TIR24: TCR Index Register
TIR25: Configuration Data Port
TIR26: Antenna Diversity and A/D Control
TIR27: Serial Approximation Register
TIR28: RSSI Lower Limit
TIR29: USER Pin Data
TIR30: Test Dummy Register
TIR31: TEST
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TAI Configuration Register space (TCR)
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TCR0: Network Configuration
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TCR1: Transmit Configuration
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TCR2: Clock Recovery
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TCR3: Receive Configuration
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TCR4: Antenna Diversity Timer
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TCR5: TX Ramp Up Timing
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TCR6: TX Ramp Down Timing
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TCR7: Pin Data A
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TCR8: Start Delimiter LSB
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TCR9: Start Delimiter CSB
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TCR10: Start Delimiter MSB
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TCR11: Interrupt Register 3
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TCR12: Interrupt Unmask Register 3
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TCR13: Pin Configuration A
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TCR14: Pin Configuration B
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TCR15: Pin Configuration C
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TCR16: Baud Detect Start
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TCR17: Baud Detect Lower Limit
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TCR18: Baud Detect Upper Limit.
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TCR19: Baud Detect Accept Count for Carrier Sense
TCR20: Baud Detect Accept Count for Stop Diversity
TCR21: Baud Detect Ratio
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TCR22: Baud Detect Accept Count
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TCR23: Baud Detect Fail Count
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