參數(shù)資料
型號(hào)： AM79C970AKC
廠商： ADVANCED MICRO DEVICES INC
元件分類： 微控制器/微處理器
英文描述： PCnet-PCI II Single-Chip Full-Duplex Ethernet Controller for PCI Local Bus Product
中文描述： 2 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP13
封裝： CARRIER RING, PLASTIC, QFP-132
文件頁(yè)數(shù)： 100/219頁(yè)
文件大?。?/td> 1065K
代理商： AM79C970AKC
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AMD
P R E L I M I N A R Y
100
Am79C970A
Pin 120 (
RST
) is the first input to the NAND tree. Pin 117
(
INTA
) is the second input to the NAND tree, followed by
pin 121 (CLK). All other PCI bus signals follow, counter-
clockwise, with pin 57 (AD0) being the last. Pins labeled
NC and all power supply pins are not part of the NAND
tree. The table below shows the complete list of pins
connected to the NAND tree.
Table 17. NAND Tree Pin Sequence
NAND
Tree
Input No.
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
NAND
Tree
Input No.
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
NAND
Tree
Input No.
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
Pin No.
120
117
121
123
126
128
129
131
132
2
3
5
6
7
10
12
13
Name
RST
INTA
CLK
GNT
REQ
AD31
AD30
AD29
AD28
AD27
AD26
AD25
AD24
C/
BE
3
IDSEL
AD23
AD22
Pin No.
15
16
18
19
21
22
23
24
25
26
27
28
29
31
32
34
35
Name
AD21
AD20
AD19
AD18
AD17
AD16
C/
BE
2
FRAME
IRDY
TRDY
DEVSEL
STOP
LOCK
PERR
SERR
PAR
C/
BE
1
Pin No.
36
38
39
40
41
42
44
45
47
48
49
51
52
53
54
56
57
Name
AD15
AD14
AD13
AD12
AD11
AD10
AD9
AD8
C/
BE
0
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
RST
must be asserted low to start a NAND tree test se-
quence. Initially, all NAND tree inputs except
RST
should be driven high. This will result in a high output at
the NOUT pin. If the NAND tree inputs are driven from
high to low in the same order as they are connected to
build the NAND tree, NOUT will toggle every time an ad-
ditional input is driven low. NOUT will change to low,
when INTA is driven low and all other NAND tree inputs
stay high. NOUT will toggle back to high, when CLK is
additionally driven low. The square wave will continue
until all NAND tree inputs are driven low. NOUT will be
high, when all NAND tree inputs are driven low.
Note, that some of the pins connected to the NAND tree
are outputs in normal mode of operation. They must not
be driven from an external source until the PCnet-PCI II
controller is configured for NAND tree testing.
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