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參數(shù)資料
| 型號(hào)： | CR16HCT5VJE7Y |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 149/157頁(yè) |
| 文件大小： | 1256K |
| 代理商： | CR16HCT5VJE7Y |
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149
www.national.com
t
SCLlowo
91
SCL low time
After SCL F.E.
K*t
CLK
-
1
e
K*t
CLK
-
1
e
t
SCLhigho
91
SCL high time
After SCL R.E.
t
SDAfo
t
SDAro
88
88
SDA signal Fall time
SDA signal Rise time
300
-
t
SDAho
91
SDA hold time
After SCL F.E.
7*t
CLK
-
t
SCLfo
t
SDAvo
91
SDA valid time
After SCL F.E.
7*tCLK+
tRD
a. Tclk is the actual clock period of the CPU clock used in the system.
The value of Tclk is system dependent.
The maximum cycle time of 64000ns is for Power Save mode; in active mode, the maximum cycle time is limited to 250ns by
the high frequency oscillator.
b. Guaranteed by design, but not fully tested.
c. Assuming signal’s capacitance up to 400pF.
d. Depends on the signal’s capacitance and the pull-up value. Must be less than 1ms.
e. K is as defined in ACBCTL2.SCLFRQ.
Table 46
Input Signal Requirements
Symbol Figure
Description
Reference
Min (ns)
Max (ns)
t
X1p
t
X1h
t
X1l
t
X2p
t
X2h
t
X2l
77
77
77
77
77
77
X1 period
X1 high time, external clock
X1 low time, external clock
X2 period
a
X2 high time, external clock
X2 low time, external clock
Input setup time
ISE
Input hold time
ISE, NMI, RXD1, RXD2
Reset time
R.E. X1 to next R.E. X1
At 2V level (Both Edges)
At 0.8V level (Both Edges)
R.E. X2 to next R.E. X2
At 2V level (both edges)
At 0.8V level (both edges)
Before R.E. CLK
40
0.5 Tclk - 4
0.5 Tclk - 4
10,000
0.5 Tclk - 500
0.5 Tclk - 500
t
Is
81
12
t
Ih
81
After R.E. CLK
0
t
RST
82
Reset active to reset end
4Tclk
Input Signals
Input Pulse Width
1*Tclk+13
USART Input Signals
t
Is
80
Input setup time
RXDn (asynchronous mode)
Input hold time
RXDn (asynchronous mode)
CKXn input period
(synchronous mode)
RDXn setup time
(synchronous mode)
RDXn hold time
(synchronous mode)
Before R.E. CLK
12
t
Ih
80
After R.E. CLK
0
t
CLKX
81
200
t
RXS
81
Before F.E. CKX in synchronous mode
4
t
RXH
81
After F.E. CKX in synchronous mode
2
Table 45
Output Signals
Symbol Figure
Description
Reference
Min (ns) Max (ns)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CR16HCT5VJE8Y | Microcontroller |
| CR16HCT5VJE9Y | Microcontroller |
| CR16HCT9 | |
| CR16HCT9VJE7 | Microcontroller |
| CR16HCT9VJE7Y | Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CR16HCT5VJE8Y | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| CR16HCT5VJE9Y | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| CR16HCT5VJEXY | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:CR16MCT9/CR16MCT5/CR16HCT9/CR16HCT5 16-Bit Reprogrammable/ROM Microcontroller |
| CR16HCT9 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:CR16MCT9/CR16MCT5/CR16HCT9/CR16HCT5 16-Bit Reprogrammable/ROM Microcontroller |
| CR16HCT9VJE7 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
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