參數(shù)資料
型號(hào)： DS3134
英文描述： Chateau Channelized T1 And E1 And HDLC Controller
中文描述： 不推薦用于新設(shè)計(jì)
文件頁(yè)數(shù)： 84/203頁(yè)
文件大?。?/td> 777K
代理商： DS3134
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DS3134
84 of 203
Register Name:
Register Description:
Transmit HDLC Channel Definition
Register Address:
0484h
THCD
7
6
5
4
3
2
1
0
TABTE
15
n/a
Note: Bits that are underlined are read only, all other bits are read-write.
TCFCS
14
n/a
TBF
13
n/a
TID
12
TZSD
TCRC1
11
TFG3
TCRC0
10
TFG2
TIFS
9
TFG1
TTRANS
8
TFG0
Bit 0 / Transmit Transparent Enable (TTRANS).
When this bit is set low, the HDLC engine will
generate flags and the FCS (if enabled via TCRC0/1) and perform zero stuffing. When this bit is set high,
the HDLC engine does not generate flags or the FCS and does not perform zero stuffing.
0 = transparent mode disabled
1 = transparent mode enabled
Bit 1 / Transmit Interfill Select (TIFS).
0 = the interfill byte is 7Eh (01111110)
1 = the interfill byte is FFh (11111111)
Bit 2 & Bit 3 / Transmit CRC Selection (TCRC0/TCRC1).
These 2 bits are ignored if the HDLC
channel is set into Transparent mode (TTRANS = 1).
TCRC1
0
0
1
1
TCRC0
0
1
0
1
Action
no CRC is generated
16-bit CRC (CCITT/ITU Q.921)
32-bit CRC
illegal state
Bit 4 / Transmit Invert Data Enable (TID).
When this bit is set low, the outgoing HDLC packets are
not inverted after being generated. When this bit is set high, the HDLC engine inverts all the data (flags,
information fields, and FCS) after the packet has been generated.
0 = do not invert data
1 = invert all data (including flags and FCS)
Bit 5 / Transmit Bit Flip (TBF).
When this bit is set low, the HDLC engine will obtain the first HDLC
bit to be transmitted from the lowest bit position of the PCI Bus bytes (i.e. PAD[0] / PAD[8] / PAD[16] /
PAD[24]). When this bit is set high, the HDLC engine will obtain the first HDLC bit to be transmitted
from the highest bit position of the PCI Bus bytes (i.e. PAD[7] / PAD[15] / PAD[23] / PAD[31]).
0 = the first HDLC bit transmitted is obtained from the lowest bit position of the bytes on the
PCI Bus
1 = the first HDLC bit transmitted is obtained from the highest bit position of the bytes on the
PCI Bus
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PDF描述
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