參數(shù)資料
型號： DS32512DK
廠商： Maxim Integrated Products
文件頁數(shù)： 92/130頁
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描述： KIT DEMO FOR DS32512
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
設計資源： DS32512 Gerber Files
標準包裝： 1
主要目的： 電信，線路接口單元（LIU）
已用 IC / 零件： DS32512
DS32506/DS32508/DS32512
64 of 130
Register Name:
PORT.CR2
Register Description:
Port Control Register 2
Register Address:
n * 80h + 02h
Bit #
15
14
13
12
11
10
9
8
Name
—
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
LM[1:0]
—
ROD
TBIN
RBIN
TCC
—
Default
0
Bits 7 and 6: LIU Mode (LM[1:0]).
These bits select the operating mode of the port. See Section 8.1.
00 = DS3
01 = E3
10 = STS-1
11 = reserved
Bit 4: Receive Output Disable (ROD).
See Section 8.3.6.4.
0 = enable the receiver outputs
1 = disable the receiver outputs (RCLK, RPOS/RDAT, and RNEG/RLCV)
Bit 3: Transmit Binary Interface Enable (TBIN).
See Section 8.2.2.
0 = Transmitter framer interface is bipolar on the TPOS and TNEG pins. The B3ZS/HDB3 encoder
is disabled.
1 = Transmitter framer interface is binary on the TDAT pin. The B3ZS/HDB3 encoder is enabled.
Bit 2: Receive Binary Interface Enable (RBIN).
See Section 8.3.6.
0 = Receiver framer interface is bipolar on the RPOS and RNEG pins. The B3ZS/HDB3 decoder is
disabled.
1 = Receiver framer interface is binary on the RDAT pin with the RLCV pin indicating line-code
violations. The B3ZS/HDB3 encoder is enabled.
Bit 1: Transmit Common Clock Mode (TCC).
See Section 8.2.1.1.
0 = Source transmit clock for port n from TCLKn
1 = Source transmit clock for port n from TCLK1
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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