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參數(shù)資料
| 型號： | EVAL-ADUC832QSZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 2/92頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT DEV FOR ADUC832 QUICK START |
| 產(chǎn)品培訓模塊： | Process Control |
| 標準包裝： | 1 |
| 系列： | QuickStart™ 套件 |
| 類型： | MCU |
| 適用于相關產(chǎn)品： | ADuC832 |
| 所含物品： | 評估板，線纜，電源，軟件和文檔 |
| 其它名稱： | EVAL-ADUC832QS EVAL-ADUC832QS-ND |
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ADuC832
Data Sheet
Rev. B | Page 10 of 92
TIMING SPECIFICATIONS
AVDD = 2.7 V to 3.6 V or 4.75 V to 5.25 V, DVDD = 2.7 V to 3.6 V or 4.75 V to 5.25 V; all specifications TMIN to TMAX, unless otherwise noted.
Table 2. Clock Input (External Clock Applied on XTAL1)
32.768 kHz External Crystal
Parameter1, 2, 3
Description
Min
Typ
Max
Unit
tCK
XTAL1 period (see Figure 3)
30.52
μs
tCKL
XTAL1 width low (see Figure 3)
15.16
μs
tCKH
XTAL1 width high (see Figure 3)
15.16
μs
tCKR
XTAL1 rise time (see Figure 3)
20
ns
tCKF
XTAL1 fall time (see Figure 3)
20
ns
1/tCORE
ADuC832 core clock frequency4
0.131
16.78
MHz
tCORE
ADuC832 core clock period5
0.476
μs
tCYC
ADuC832 machine cycle time6
0.72
5.7
91.55
μs
1 AC inputs during testing are driven at DVDD 0.5 V for a Logic 1 and 0.45 V for a Logic 0. Timing measurements are made at VIH minimum for a Logic 1 and VIL maximum for
a Logic 0, as shown in Figure 4.
2 For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to float when a 100 mV change from the
3 CLOAD for all outputs = 80 pF, unless otherwise noted.
4 The ADuC832 internal PLL locks onto a multiple (512 times) the external crystal frequency of 32.768 kHz to provide a stable 16.78 MHz internal clock for the system.
The core can operate at this frequency or at a binary submultiple called Core_CLK, selected via the PLLCON SFR.
5 This number is measured at the default Core_CLK operating frequency of 2.09 MHz.
6 ADuC832 machine cycle time is nominally defined as 12/Core_CLK.
tCKH
tCKL
tCK
tCKF
tCKR
0
29
87-
0
86
Figure 3. XTAL1 Input
DVDD –0.5V
0.45V
0.2DVDD + 0.9V
TEST POINTS
0.2DVDD – 0.1V
VLOAD – 0.1V
VLOAD
VLOAD + 0.1V
TIMING
REFERENCE
POINTS
VLOAD – 0.1V
VLOAD
VLOAD + 0.1V
0
29
87-
0
87
Figure 4. Timing Waveform Characteristics
相關PDF資料 |
PDF描述 |
|---|---|
| HBM15DRXS | CONN EDGECARD 30POS DIP .156 SLD |
| PCX1H270MCL1GS | CAP ALUM 27UF 50V 20% SMD |
| HSM08DRKI | CONN EDGECARD 16POS DIP .156 SLD |
| 0210490857 | CABLE JUMPER 1.25MM .051M 17POS |
| EVAL-ADUC831QSZ | KIT DEV FOR ADUC831 QUICK START |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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