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參數(shù)資料
| 型號： | GT-48208 |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Switched Ethernet Controllers for 10+10/100 BaseX(高級交換式 10+10/100 BaseX以太網(wǎng)控制器) |
| 中文描述： | 先進的交換式以太網(wǎng)控制器的10 10/100 BaseX（高級交換式10 10/100 BaseX以太網(wǎng)控制器） |
| 文件頁數(shù)： | 113/135頁 |
| 文件大小： | 1619K |
| 代理商： | GT-48208 |
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GT-482xx Switched Ethernet Controllers for 10+10/100 BaseX
GALI
L
E
O
TECHNOLOGY
CONFI
D
ENTI
AL
--
DO
NOT
REPRODUCE
Revision 1.2
79
16.7
CPU Interface Priority
CPU Access to the GT-482xx’s DRAM is the lowest priority in the DRAM arbiter. In order to prevent deadlocks, the
GT-482xx incorporates a CPU-to-DRAM access timer. This timer starts counting when the CPU requests an
access to the DRAM. When the timer expires, the CPU will be the next master to access the DRAM. The timer can
be enabled and programed via CPU Time Out Register.
16.8
Memory Endianess
The GT-482xx treats SDRAM as a little-endian array. When data is fetched from a 32-bit word for transmission it
is fetched in the following sequence: bits [7:0], bits [15:8], bits [23:16], bits [31:24]. The software engineer should
keep this in mind when creating/modifying packets within GT-482xx memory.
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PDF描述 |
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參數(shù)描述 |
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| GT48300-A1-BBE-C08 | 制造商:Marvell 功能描述:MVLGT48300-A1-BBE-C083 4 PORT 83MHZ G.LI |
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