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參數(shù)資料
| 型號： | GT-48208 |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Switched Ethernet Controllers for 10+10/100 BaseX(高級交換式 10+10/100 BaseX以太網(wǎng)控制器) |
| 中文描述： | 先進的交換式以太網(wǎng)控制器的10 10/100 BaseX（高級交換式10 10/100 BaseX以太網(wǎng)控制器） |
| 文件頁數(shù)： | 74/135頁 |
| 文件大小： | 1619K |
| 代理商： | GT-48208 |
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GT-482xx Switched Ethernet Controllers for 10+10/100 BaseX
GALI
L
E
O
TECHNOLOGY
CONFI
D
ENTI
AL
--
DO
NOT
REPRODUCE
Revision 1.2
43
Data (Data). The data field is 16 bits long. The PHY drives the data field during Read transactions. The
GT-482xx drives the data field during write transactions. The first data bit transmitted and received will be
bit 15 of the PHY register being addressed.
IDLE (Idle). The IDLE condition on MDIO is a high impedance state. The MDIO driver is disabled and the
PHY should pull-up the MDIO line to a logic one.
8.15.2 SMI Timing Requirements
When the MDIO signal is driven by the PHY, it is sampled by the GT-482xx synchronously with respect to the ris-
ing edge of MDC. Per IEEE 802.3 specification, the MDC to output delay must be a minimum of 0ns and a maxi-
mum of 300ns as shown in Figure 6. In addition, when the MDIO signal is driven by the GT-482xx, the GT-482xx
provides a minimum of 10ns of setup time and minimum of 10ns of hold time as shown in Figure 7
.
Figure 6: MDIO Output Delay
Figure 7: Required MDIO Setup and Hold Time
8.16
Link Detection and Link Detection Bypass (ForceLinkPass)
Typically, the GT-482xx will continuously query the PHY devices for its link status, without CPU intervention. The
predefined PHY addresses for the link query are 1 and 2 (out of possible 32 addresses). The GT-482xx alternately
0ns MIN
300ns MAX
MDC
MDIO
Vih
min
Vil
max
Vih
min
Vil
max
10ns
MIN
MDC
MDIO
10ns
MIN
Vih
min
Vil
max
Vih
min
Vil
max
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