參數(shù)資料
型號： IDT82V2108PX8
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 40/292頁
文件大小： 0K
描述： IC FRAMER T1/J1/E1 8CH 128-PQFP
標準包裝： 500
控制器類型： T1/E1/J1 調(diào)幀器
接口： 并聯(lián)
電源電壓： 2.97 V ~ 3.63 V
電流 - 電源： 160mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 128-BFQFP
供應(yīng)商設(shè)備封裝： 128-PQFP（14x20）
包裝： 帶卷 (TR)
其它名稱： 82V2108PX8
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Programming Information
124
March 5, 2009
5
PROGRAMMING INFORMATION
The Micro-Processor Interface provides the logic to connect the microprocessor interface. For all accesses, CS must be low. The data bus and
address bus of the interface can work in the multiplexed on non-multiplexed mode. In the non-multiplexed mode, the ALE pin should be connected to
high. In the multiplexed mode, data bus and address bus should be externally connected.
5.1
REGISTER MAP
The registers are divided into two parts: E1 part and T1/J1 part. Before operation, the TEMODE (b0, 400H) must be set to specify which part to
be accessed by the microprocessor.
5.1.1
E1 MODE REGISTER MAP
When the TEMODE (b0, 400H) is logic 0, the E1 mode registers are accessed.
Table 61: T1/J1 Mode Selection Register
Address
Register
400
T1/E1 Mode Selection
Table 62: E1 Mode Register Map - Direct Register
E1 Address
Register
Framer 1
Framer 2
Framer 3
Framer4
Framer 5
Framer 6
Framer 7
Framer8
000
080
100
180
200
280
300
380
Receive Path Line Options
001
081
101
181
201
281
301
381
Receive Side System Interface Options
002
082
102
182
202
282
302
382
Transmit Path Configuration
003
083
103
183
203
283
303
383
Transmit Side System Interface Options
004
084
104
184
204
284
304
384
Transmit Timing Options
005
085
105
185
205
285
305
385
Interrupt Source #1
006
086
106
186
206
286
306
386
Interrupt Source #2
007
087
107
187
207
287
307
387
Diagnostic
008
088
108
188
208
288
308
388
Reserved
009
Chip ID/ Global PMON Update
00A
08A
10A
18A
20A
28A
30A
38A
HDLC Micro Select/Framer Reset
00B
Framer Interrupt ID
00C
PRGD Positioning/Control
00D
08D
10D
18D
20D
28D
30D
38D
Clock Monitor
00E
08E
10E
18E
20E
28E
30E
38E
Receive Path Frame Pulse Configuration
00F
08F
10F
18F
20F
28F
30F
38F
Reserved
010
090
110
190
210
290
310
390
RESI Configuration
011
091
111
191
211
291
311
391
RESI Frame Pulse Configuration
012
092
112
192
212
292
312
392
RESI Parity Configuration
013
093
113
193
213
293
313
393
RESI Time Slot Offset
014
094
114
194
214
294
314
394
RESI Bit Offset
015 ~ 017 095 ~ 097 115 ~ 117 195 ~ 197 215 ~ 217 295 ~ 297 315 ~ 317 395 ~ 397
Reserved
018
098
118
198
218
298
318
398
TRSI Configuration
019
099
119
199
219
299
319
399
TRSI Frame Pulse Configuration
01A
09A
11A
19A
21A
29A
31A
39A
TRSI Parity Configuration and Status
01B
09B
11B
19B
21B
29B
31B
39B
TRSI Time Slot Offset
01C
09C
11C
19C
21C
29C
31C
39C
TRSI Bit Offset
01D ~ 01F 09D ~ 09F 11D ~ 11F 19D ~ 19F 21D ~ 21F 29D ~ 29F 31D ~ 31F 39D ~ 39F
Reserved
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